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參數(shù)資料
| 型號(hào)： | μPD78018FY |
| 廠商： | NEC Corp. |
| 元件分類(lèi)： | 8位微控制器 |
| 英文描述： | 8 Bit Single Chip Microcontrollers |
| 中文描述： | 8位單片機(jī)微控制器 |
| 文件頁(yè)數(shù)： | 18/521頁(yè) |
| 文件大?。?/td> | 1988K |
| 代理商： | ΜPD78018FY |
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18
3.2.16
3.2.17
I/O Circuits of Pins and Handling of Unused Pins .....................................................
V
PP
(
μ
PD78P018F only) .....................................................................................................
IC (mask ROM model only)................................................................................................
75
75
76
3.3
CHAPTER 4 PIN FUNCTIONS (
μ
PD78018FY SUBSERIES)........................................................
4.1
List of Pin Functions .......................................................................................................
4.1.1
Pins in normal operation mode ..........................................................................................
4.1.2
Pins in PROM programming mode (
μ
PD78P018FY only)................................................
4.2
Description of Pin Functions .........................................................................................
4.2.1
P00-P04 (Port0) ..................................................................................................................
4.2.2
P10-P17 (Port1) ..................................................................................................................
4.2.3
P20-P27 (Port2) ..................................................................................................................
4.2.4
P30-P37 (Port3) ..................................................................................................................
4.2.5
P40-P47 (Port4) ..................................................................................................................
4.2.6
P50-P57 (Port5) ..................................................................................................................
4.2.7
P60-P67 (Port6) ..................................................................................................................
4.2.8
AV
REF
...................................................................................................................................
4.2.9
AV
DD
....................................................................................................................................
4.2.10
AV
SS
.....................................................................................................................................
4.2.11
RESET.................................................................................................................................
4.2.12
X1 and X2 ...........................................................................................................................
4.2.13
XT1 and XT2.......................................................................................................................
4.2.14
V
DD
.......................................................................................................................................
4.2.15
V
SS
.......................................................................................................................................
4.2.16
V
PP
(
μ
PD78P018FY only)...................................................................................................
4.2.17
IC (mask ROM model only)................................................................................................
4.3
I/O Circuits of Pins and Handling of Unused Pins .....................................................
79
79
79
82
83
83
83
84
85
85
86
86
86
86
86
87
87
87
87
87
87
87
88
CHAPTER 5 CPU ARCHITECTURE...............................................................................................
5.1
Memory Space..................................................................................................................
5.1.1
Internal program memory space ........................................................................................
5.1.2
Internal data memory space ..............................................................................................
5.1.3
Special function register (SFR) area .................................................................................
5.1.4
External memory space......................................................................................................
5.2
Processor Registers ........................................................................................................
5.2.1
Control registers .................................................................................................................
5.2.2
General-purpose registers..................................................................................................
5.2.3
Special function registers (SFRs) ......................................................................................
5.3
Addressing Instruction Address ...................................................................................
5.3.1
Relative addressing ............................................................................................................
5.3.2
Immediate addressing ........................................................................................................
5.3.3
Table indirect addressing ...................................................................................................
5.3.4
Register addressing............................................................................................................
5.4
Addressing of Operand Address...................................................................................
5.4.1
Data memory addressing ...................................................................................................
5.4.2
Implied addressing..............................................................................................................
5.4.3
Register addressing............................................................................................................
5.4.4
Direct addressing................................................................................................................
91
91
99
100
101
101
102
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