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參數(shù)資料
| 型號(hào)： | ZPSD303V |
| 英文描述： | Field Programmable Microcontroller Peripherals(可編程邏輯,零功耗，16K位SRAM,19個(gè)可編程I/O,通用PLD有16個(gè)輸入) |
| 中文描述： | 現(xiàn)場(chǎng)可編程微控制器外圍設(shè)備（可編程邏輯，零功耗，16K的位的SRAM，19余個(gè)可編程輸入/輸出，通用PLD的有16個(gè)輸入） |
| 文件頁數(shù)： | 21/90頁 |
| 文件大?。?/td> | 491K |
| 代理商： | ZPSD303V |
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ZPSD3XX Famly
3-21
NOTES:
19. When the data bus width is 16, Port B registers can only be accessed if the BHE
signal is low.
20. I/O Ports A and B are still byte-addressable, as shown in Table 6. For I/O Port B register
access, BHE must be low.
Register Name
Word Size Access of the I/OPort Registers
Ofset fromthe CSIOPORT
Pin Register of Ports B and A
Direction Register of Ports B and A
Data Register of Ports B and A
Power Management Register
Page Register
+ 2 (accessible during read operation only)
+ 4
+ 6
+ 10
+ 18
Table 7.
I/OPort
Addresses in a
16-bit Data Bus
Mode
19,20
(ZPSD30X)
Figure 7.
Port B Pin
Structure
READ PIN
READ DATA
PORT B PIN
CMOS/OD
(18)
OUT
WRITE DATA
CK
DR
DFF
ENABLE
MUX
DI
CSI
CONTROL
DIR
FF
D
CK
R
WRITE DIR
RESET
READ DIR
I
N
T
E
R
N
A
L
I
N
T
E
R
N
A
L
C
S
O
U
T
D
A
T
A
B
U
S
B
U
S
C
S
0
7
D
8
D
1
5
Register Name
Byte Size Access of the I/OPort Registers
Ofset fromthe CSIOPORT
+ 2 (accessible during read operation only)
+ 4
+ 6
+ 3 (accessible during read operation only)
+ 5
+ 7
+ 10
+ 18
Pin Register of Port A
Direction Register of Port A
Data Register of Port A
Pin Register of Port B
Direction Register of Port B
Data Register of Port B
Power Management Register
Page Register
Table 6.
I/OPort
Addresses in an
8-bit Data Bus
Mode
NOTE:
18. CMOS/OD determines whether the output is open drain or CMOS.
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