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參數(shù)資料
| 型號： | XR17V358IB176-F |
| 廠商： | Exar Corporation |
| 文件頁數(shù)： | 36/68頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC UART PCIE OCTAL 176FPBGA |
| 產(chǎn)品培訓(xùn)模塊： | PCIe UARTs UART Product Overview |
| 標(biāo)準(zhǔn)包裝： | 160 |
| 特點(diǎn)： | * |
| 通道數(shù)： | 1，UART |
| FIFO's： | 256 字節(jié) |
| 規(guī)程： | RS485 |
| 電源電壓： | 1.2V，3.3V |
| 帶自動流量控制功能： | 是 |
| 帶IrDA 編碼器/解碼器： | 是 |
| 帶故障啟動位檢測功能： | 是 |
| 帶調(diào)制解調(diào)器控制功能： | 是 |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 176-LFBGA |
| 供應(yīng)商設(shè)備封裝： | 176-FPBGA（13x13） |
| 包裝： | 托盤 |
| 配用： | 1016-1296-ND - EVAL BOARD FOR XR17V358-E8 1016-1295-ND - EVAL BOARD FOR XR17V358-E4 1016-1293-ND - EVAL BOARD FOR XR17V358 |
| 其它名稱： | 1016-1294 |
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XR17V358
41
REV. 1.0.4
HIGH PERFORMANCE OCTAL PCI EXPRESS UART
3.4
Internal Loopback
Each UART channel provides an internal loopback capability for system diagnostic. The internal loopback
mode is enabled by setting MCR register bit [4] to a logic 1. All regular UART functions operate normally.
Figure 12 shows how the modem port signals are re-configured. Transmit data from the transmit shift register
output is internally routed to the receive shift register input allowing the system to receive the same data that it
was sending. The TX pin is held at HIGH or mark condition while RTS# and DTR# are de-asserted. The CTS#,
DSR#, CD# and RI# inputs are ignored.
FIGURE 12. INTERNAL LOOP BACK
T X [7 :0 ]
R X [7 :0 ]
Mode
m
/
Genera
l
P
u
rpo
s
e
Contro
l
Lo
gic
Inter
n
al
B
u
s
Lines
an
d
C
ontr
ol
S
ignal
s
R T S # [7 :0 ]
M C R bit-4=1
VC C
Tran sm it S h ift
R egiste r
R e ce ive S h ift
Re g is te r
C T S # [7 :0 ]
D T R # [7 :0 ]
D S R # [7 :0 ]
R I# [7 :0 ]
CD# [7 :0 ]
OP 1 #
OP 2 #
RT S #
CT S #
DT R#
DS R#
RI#
CD#
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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