FIGURE 25. T
參數(shù)資料
型號： XR16M564IV80-0A-EB
廠商： Exar Corporation
文件頁數(shù)： 43/55頁
文件大?。?/td> 0K
描述： EVAL BOARD FOR XR16M564-A 80LQFP
標準包裝： 1
系列： *
XR16M564/564D
48
1.62V TO 3.63V QUAD UART WITH 32-BYTE FIFO
REV. 1.0.0
FIGURE 25. TRANSMIT READY & INTERRUPT TIMING [FIFO MODE, DMA MODE ENABLED] FOR CHANNELS A-D
TX
TXRDY#
IOW#
INT*
D0:D7
S
TXDMA
D0:D7
S
D0:D7
T
D0:D7
S
D0:D7
S
T
D0:D7
S
T
D0:D7
S
T
Start
Bit
Stop
Bit
T
WRI
T
(Unloading)
(Loading data
into FIFO)
Last Data Byte
Transmitted
TX FIFO fills up
to trigger level
TX FIFO drops
below trigger level
At least 1
empty location
in FIFO
T
SRT
TX FIFO
Full
T
WT
T
SI
ISR Read
*INT cleared when the ISR is read or when TX FIFO fills up to trigger level.
IER[1]
enabled
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PDF描述
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參數(shù)描述
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