參數(shù)資料
型號(hào)： XIO2200AZHH
廠商： Texas Instruments
文件頁(yè)數(shù)： 178/202頁(yè)
文件大?。?/td> 0K
描述： IC PCI-EXPRESS/BUS BRIDGE 175BGA
產(chǎn)品培訓(xùn)模塊： PCI Express Basics
標(biāo)準(zhǔn)包裝： 160
應(yīng)用： PCI Express 至 PCI 轉(zhuǎn)換橋
接口： PCI
電源電壓： 1.35 V ~ 1.65 V，3 V ~ 3.6 V
封裝/外殼： 175-BGA Microstar+
供應(yīng)商設(shè)備封裝： 175-BGA MICROSTAR（12x12）
包裝： 托盤
安裝類型： 表面貼裝
產(chǎn)品目錄頁(yè)面： 882 (CN2011-ZH PDF)
配用： XIO2200AEVM-ND - XIO2200AEVM
其它名稱： 296-21636
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Classic PCI Configuration Space
64
March 5 2007 June 2011
SCPS154C
4.53 Link Control Register
The link control register controls link specific behavior. See Table 429 for a complete description of the
register contents.
PCI register offset:
A0h
Register type:
Read-only, Read/Write
Default value:
0000h
BIT NUMBER
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
RESET STATE
0
Table 429. Link Control Register Description
BIT
FIELD NAME
ACCESS
DESCRIPTION
15:8
RSVD
RW
Reserved. Returns 00h when read.
7
ES
RW
Extended synch. This bit forces the bridge to extend the transmission of FTS ordered sets and an
extra TS2 when exiting from L1 prior to entering to L0.
0 = Normal synch (default)
1 = Extended synch
6
CCC
RW
Common clock configuration. When this bit is set, it indicates that the bridge and the device at the
opposite end of the link are operating with a common clock source. A value of 0b indicates that the
bridge and the device at the opposite end of the link are operating with separate reference clock
sources. The bridge uses this common clock configuration information to report the correct L0s and
L1 exit latencies.
0 = Reference clock is asynchronous (default)
1 = Reference clock is common
5
RL
R
Retrain link. This bit has no function and is read-only 0b.
4
LD
R
Link disable. This bit has no function and is read-only 0b.
3
RCB
RW
Read completion boundary. This bit is an indication of the RCB of the root complex. The state of
this bit has no affect on the bridge, since the RCB of the bridge is fixed at 128 bytes.
0 = 64 bytes (default)
1 = 128 bytes
2
RSVD
R
Reserved. Returns 0b when read.
1:0
ASLPMC
RW
Active state link PM control. This field enables and disables the active state PM.
00 = Active state PM disabled (default)
01 = L0s entry enabled
10 = L1 entry enabled
11 = L0s and L1 entry enabled
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PDF描述
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