參數(shù)資料
型號(hào)： XC9500
廠商： Xilinx, Inc.
英文描述： XC9500 In-System Programmable CPLD Family
中文描述： XC9500在系統(tǒng)可編程CPLD系列
文件頁(yè)數(shù)： 14/16頁(yè)
文件大?。?/td> 172K
代理商： XC9500
XC9500 In-System Programmable CPLD Family
14
www.xilinx.com
1-800-255-7778
DS063 (v5.1) September 22, 2003
Product Specification
R
Figure 14:
Basic Timing Model
Figure 15:
Detailed Timing Model
Combinatorial
Logic
Propagation Delay = T
PD
(a)
Combinatorial
Logic
Setup Time = T
SU
T
CO
T
PSU
T
PCO
Clock to Out Time = T
CO
(b)
D/T Q
Combinatorial
Logic
Internal System Cycle Time = T
SYSTEM
(d)
DS063_14_110501
D/T Q
Combinatorial
Logic
Setup Time = T
PSU
Clock to Out Time = T
PCO
(c)
P-Term Clock
Path
D/T Q
Combinatorial
Logic
All resources within FB using local Feedback
Internal Cycle Time = T
CNT
(e)
D/T Q
D/T
Q
SR
T
IN
T
LOGILP
S*T
PTA
Pin Feedback
T
F
T
PDI
T
SUI
T
COI
T
HI
T
AOI
T
RAI
T
OUT
T
SLEW
T
EN
DS063_15_110501
T
LOGI
T
PTCK
T
PTSR
T
PTTS
T
GCK
T
GSR
T
GTS
Macrocell
EC
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PDF描述
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