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參數(shù)資料
| 型號(hào)： | XC4VFX100-10FFG1517I |
| 廠商： | XILINX INC |
| 元件分類： | FPGA |
| 英文描述： | FPGA, 10544 CLBS, 1028 MHz, PBGA1517 |
| 封裝： | LEAD FREE, FBGA-1517 |
| 文件頁數(shù)： | 10/58頁 |
| 文件大?。?/td> | 1863K |
| 代理商： | XC4VFX100-10FFG1517I |
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Virtex-4 FPGA Data Sheet: DC and Switching Characteristics
DS302 (v3.7) September 9, 2009
Product Specification
18
Table 26: RocketIO Transmitter Switching Characteristics
Description
Symbol
Conditions
Min
Typ
Max
Units
Serial data rate, -10
FGTX
0.622
3.125
Gb/s
Serial data rate, -11
FGTX
0.622
6.5
Gb/s
Data
Rate (Gb/s)
TX Jitter Generation(3)
TJ
PRBS7
6.5
0.50
UI(1)
RJ
0.35
DJ
0.30
TJ
PRBS7
5.0
0.45
RJ
0.30
DJ
0.25
TJ
PRBS7
4.25
0.40
RJ
0.25
DJ
0.21
TJ
PRBS7
3.125
0.28
RJ
0.14
DJ
0.14
TJ
PRBS7
2.5
0.25
RJ
0.18
DJ
0.12
TJ
PRBS7
1.25
0.12
RJ
0.10
DJ
0.06
TJ
PRBS31
0.622
0.08
RJ
0.06
DJ
0.04
TX rise time(2)
TRTX
20% – 80%
90
ps
TX fall time(2)
TFTX
20% – 80%
90
ps
TXUSRCLK frequency
For slower speed grades =
MaxDataRate/32
250
MHz
TXUSRCLK2 frequency
250
MHz
TXUSRCLK duty cycle
TTXDC
40
60
%
TXUSRCLK2 duty cycle
TTX2DC
40
60
%
Differential output skew
TISKEW
12
20
ps
Electrical idle transition time
TXOOBTransition
15
ns
Notes:
1.
UI = Unit Interval.
2.
Default attributes, measured at 2.5 Gb/s.
3.
Peak-to-Peak values measured relative to 1e-12 Error rate. Default attributes. TX feedback divider (TXPLLNDIVSEL) = 10.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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| XC4VFX100-12FFG1152C | FPGA, 10544 CLBS, 1181 MHz, PBGA1152 |
| XC4VFX100-12FFG1517C | FPGA, 10544 CLBS, 1181 MHz, PBGA1517 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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