參數(shù)資料
型號： XC3S1500L-4FGG320C
廠商： Xilinx Inc
文件頁數(shù)： 254/272頁
文件大?。?/td> 0K
描述： SPARTAN-3A FPGA 1.5M STD 320FBGA
產(chǎn)品變化通告： Product Discontinuation Notice 14/May/2007
標準包裝： 1
系列： Spartan®-3
LAB/CLB數(shù)： 2816
邏輯元件/單元數(shù)： 29952
RAM 位總計： 589824
輸入/輸出數(shù)： 221
門數(shù)： 1500000
電源電壓： 1.14 V ~ 1.26 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 320-BGA
供應(yīng)商設(shè)備封裝： 320-FBGA（19x19）
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Spartan-3 FPGA Family: DC and Switching Characteristics
DS099 (v3.1) June 27, 2013
Product Specification
82
HSTL_III_18
1.1
VREF – 0.5
VREF + 0.5
50
1.8
VREF
HSTL_III_DCI_18
LVCMOS12
-
0
1.2
1M
0
0.6
LVCMOS15
-
0
1.5
1M
0
0.75
LVDCI_15
LVDCI_DV2_15
HSLVDCI_15
LVCMOS18
-
0
1.8
1M
0
0.9
LVDCI_18
LVDCI_DV2_18
HSLVDCI_18
LVCMOS25
-
0
2.5
1M
0
1.25
LVDCI_25
LVDCI_DV2_25
HSLVDCI_25
LVCMOS33
-
0
3.3
1M
0
1.65
LVDCI_33
LVDCI_DV2_33
HSLVDCI_33
LVTTL
-
03.3
1M
01.4
PCI33_3
Rising
-
Note 3
25
0
0.94
Falling
25
3.3
2.03
SSTL18_I
0.9
VREF – 0.5
VREF + 0.5
50
0.9
VREF
SSTL18_I_DCI
SSTL18_II
0.9
VREF – 0.5
VREF + 0.5
50
0.9
VREF
SSTL2_I
1.25
VREF – 0.75
VREF + 0.75
50
1.25
VREF
SSTL2_I_DCI
SSTL2_II
1.25
VREF – 0.75
VREF + 0.75
25
1.25
VREF
SSTL2_II_DCI
50
1.25
Differential
LDT_25 (ULVDS_25)
-
VICM – 0.125
VICM + 0.125
60
0.6
VICM
LVDS_25
-
VICM – 0.125
VICM + 0.125
50
1.2
VICM
LVDS_25_DCI
N/A
BLVDS_25
-
VICM – 0.125
VICM + 0.125
1M
0
VICM
LVDSEXT_25
-
VICM – 0.125
VICM + 0.125
50
1.2
VICM
LVDSEXT_25_DCI
N/A
LVPECL_25
-
VICM – 0.3
VICM + 0.3
1M
0
VICM
RSDS_25
-
VICM – 0.1
VICM + 0.1
50
1.2
VICM
DIFF_HSTL_II_18
-
VICM – 0.5
VICM + 0.5
50
1.8
VICM
DIFF_HSTL_II_18_DCI
Table 48: Test Methods for Timing Measurement at I/Os (Cont’d)
Signal Standard
(IOSTANDARD)
Inputs
Outputs
Inputs and
Outputs
VREF (V)
VL (V)
VH (V)
RT (Ω)VT (V)
VM (V)
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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