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參數(shù)資料
| 型號： | XC2V6000-6FFG1517C |
| 廠商： | Xilinx Inc |
| 文件頁數(shù)： | 295/318頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC FPGA VIRTEX-II 6M 1517-FBGA |
| 產品變化通告： | FPGA Family Discontinuation 18/Apr/2011 |
| 標準包裝： | 1 |
| 系列： | Virtex®-II |
| LAB/CLB數(shù)： | 8448 |
| RAM 位總計： | 2654208 |
| 輸入/輸出數(shù)： | 1104 |
| 門數(shù)： | 6000000 |
| 電源電壓： | 1.425 V ~ 1.575 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 1517-BBGA，F(xiàn)CBGA |
| 供應商設備封裝： | 1517-FCBGA（40x40） |
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Virtex-II Platform FPGAs: DC and Switching Characteristics
R
DS031-3 (v3.5) November 5, 2007
Module 3 of 4
Product Specification
30
JTAG Test Access Port Switching Characteristics
Characterization data for some of the most commonly requested timing parameters shown in Figure 6 is listed in Table 33.
FI
Figure 6: Virtex-II Pro Boundary Scan Port Timing Waveforms
Table 33: Boundary-Scan Port Timing Specifications
Description
Figure
References
Symbol
Value
Units
TCK
TMS and TDI setup time
1
TTAPTCK
5.5
ns, min
TMS and TDI hold times
2
TTCKTAP
0.0
ns, min
Falling edge to TDO output valid
3
TTCKTDO
10.0
ns, max
Maximum frequency
FTCK
33.0
MHz, max
ds083-3_11_012104
Data to be captured
Data to be driven out
TDO
TCK
TDI
TMS
Data Valid
TTCKTDO
TTAPTCK
TTCKTAP
1
2
3
相關PDF資料 |
PDF描述 |
|---|---|
| XC2V6000-6FFG1152C | IC FPGA VIRTEX-II 6M 1152-FBGA |
| XC2V6000-5FFG1517I | IC FPGA VIRTEX-II 6M 1517-FBGA |
| AMM36DRSN | CONN EDGECARD 72POS DIP .156 SLD |
| XC6VLX550T-L1FF1760I | IC FPGA VIRTEX-6LXT 1760FFBGA |
| AMM36DRSH | CONN EDGECARD 72POS DIP .156 SLD |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| XC2V6000-6FG256C | 制造商:XILINX 制造商全稱:XILINX 功能描述:Virtex-II Platform FPGAs: Complete Data Sheet |
| XC2V6000-6FG256I | 制造商:XILINX 制造商全稱:XILINX 功能描述:Virtex-II Platform FPGAs: Complete Data Sheet |
| XC2V6000-6FG456C | 制造商:XILINX 制造商全稱:XILINX 功能描述:Virtex-II Platform FPGAs: Complete Data Sheet |
| XC2V6000-6FG456I | 制造商:XILINX 制造商全稱:XILINX 功能描述:Virtex-II Platform FPGAs: Complete Data Sheet |
| XC2V80 | 制造商:XILINX 制造商全稱:XILINX 功能描述:Virtex-II Platform FPGAs: Complete Data Sheet |
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