W
V
U
T
R
P
N
M
L
K
19
18
17
16
15
14
13
12
11
19
18
17
16
15
14
13
12
11
USB1_VDDA33
DVDD3318_C
CVDD
USB_CVDD
DVDD3318_C
DDR_DQGATE0
DVDD18
DDR_DQGATE1
DDR_D[9]
DDR_D[8]
DDR_D[11]
DVDD18
RTC_CVDD
RESET
USB0_DM
USB0_DP
VP_DIN[11]/
UHPI_HD[3]/
UPP_D[3]/
PRU0_R30[11]/
PRU0_R31[11]
USB0_VDDA33
USB0_VBUS
USB1_DM
VP_DIN[0]/
UHPI_HD[8]/
UPP_D[8]/
RMII_CRS_DV/
PRU1_R31[29]
VP_DIN[1]/
UHPI_HD[9]/
UPP_D[9]/
RMII_MHZ_50_CLK/
PRU0_R31[23]
VP_DIN[2]/
UHPI_HD[10]/
UPP_D[10]/
RMII_RXER/
PRU0_R31[24]
VP_DIN[4]/
UHPI_HD[12]/
UPP_D[12]/
RMII_RXD[1]/
PRU0_R31[26]
PRU0_R30[28]/
UHPI_HCNTL1/
UPP_CHA_START/
GP6[10]
USB1_DP
PLL0_VDDA
PRU0_R30[30]/
/
PRU1_R30[11]/
GP6[12]
UHPI_HINT
USB0_VDDA18
VP_DIN[5]/
UHPI_HD[13]/
UPP_D[13]/
RMII_TXEN/
PRU0_R31[27]
DDR_D[1]
VP_DIN[7]/
UHPI_HD[15]/
UPP_D[15]/
RMII_TXD[1]/
PRU0_R31[29]
OSCVSS
DDR_D[2]
VP_DIN[6]/
UHPI_HD[14]/
UPP_D[14]/
RMII_TXD[0]/
PRU0_R31[28]
VP_DIN[3]/
UHPI_HD[11]/
UPP_D[11]/
RMII_RXD[0]/
PRU0_R31[25]
VP_DIN[14]_
HSYNC/
UHPI_HD[6]/
UPP_D[6]/
PRU0_R30[14]/
PRU0_R31[14]
EMU1
VP_DIN[8]/
UHPI_HD[0]/
UPP_D[0]/
GP6[5]/
PRU1_R31[0]
USB0_VDDA12
TDI
NC_N16
PRU0_R30[26]/
UHPI_HR
/
UPP_CHA_WAIT/
GP6[8]/
PRU1_R31[17]
W
VP_DIN[12]/
UHPI_HD[4]/
UPP_D[4]/
PRU0_R30[12]/
PRU0_R31[12]
RESETOUT
UHPI_HAS
/
PRU1_R30[14]/
GP6[15]
RSV2
RTCK/
GP8[0]
OSCOUT
DDR_D[0]
PRU0_R30[27]/
UHPI_HHWIL/
UPP_CHA_ENABLE/
GP6[9]
VP_DIN[13]_
FIELD/
UHPI_HD[5]/
UPP_D[5]/
PRU0_R30[13]/
PRU0_R31[13]
TRST
OSCIN
VP_CLKIN1/
/
PRU1_R30[9]/
GP6[6]/
PRU1_R31[16]
UHPI_HDS1
VP_DIN[15]_
VSYNC/
UHPI_HD[7]/
UPP_D[7]/
PRU0_R30[15]/
PRU0_R31[15]
VP_CLKIN0/
/
PRU1_R30[10]/
GP6[7]/
UPP_2xTXCLK
UHPI_HCS
VP_DIN[10]/
UHPI_HD[2]/
UPP_D[2]/
PRU0_R30[10]/
PRU0_R31[10]
VSS
DVDD3318_B
PLL0_VSSA
TMS
PRU0_R30[31]/
/
PRU1_R30[12]
GP6[13]
UHPI_HRDY
NC_M14
PLL1_VSSA
PLL1_VDDA
USB1_VDDA18
USB0_ID
VP_DIN[9]/
UHPI_HD[1]/
UPP_D[1]/
PRU0_R30[9]/
PRU0_R31[9]
CLKOUT/
/
PRU1_R30[13]/
GP6[14]
UHPI_HDS2
USB0_DRVVBUS
DDR_DQS[0]
PRU0_R30[29]/
UHPI_HCNTL0/
UPP_CHA_CLOCK/
GP6[11]
W
V
U
T
R
P
N
M
L
K
DDR_DQM[0]
DDR_D[3]
DDR_D[4]
DDR_D[6]
DDR_ZP
DDR_D[5]
DDR_D[7]
DDR_D[14]
DDR_DQS[1]
VSS
CVDD
DVDD3318_C
A
B
C
D
SPRS653E – FEBRUARY 2010 – REVISED MARCH 2014
Figure 3-2. Pin Map (Quad B)
Copyright 2010–2014, Texas Instruments Incorporated
Device Overview
15