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參數(shù)資料
| 型號： | V54C3128164VBGA |
| 廠商： | Mosel Vitelic, Corp. |
| 英文描述： | 128Mbit SDRAM 3.3 VOLT, BGA PACKAGE |
| 中文描述： | 128Mbit SDRAM的3.3伏，BGA封裝 |
| 文件頁數(shù)： | 19/45頁 |
| 文件大小： | 871K |
| 代理商： | V54C3128164VBGA |
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19
V54C3128(16/80/40)4V(BGA) Rev. 1.2 September 2001
MOSEL VITELIC
V54C3128(16/80/40)4V(BGA)
4.2 Minimum Read to Write Interval
(Burst Length = 4, CAS latency = 2)
4.3 Non-Minimum Read to Write Interval
(Burst Length = 4, CAS latency = 2, 3)
COMMAND
NOP
BANK A
ACTIVATE
NOP
READ A
WRITE A
NOP
NOP
NOP
DQM
DIN A0
DIN A1
DIN A2
DIN A3
Must be Hi-Z before
the Write Command
t
CK2,
I/O
’
s
CAS latency = 2
CLK
T0
T2
T1
T3
T4
T5
T6
T7
T8
NOP
1 Clk Interval
t
DQZ
t
DQW
:
“
H
”
or
“
L
”
NOP
READ A
NOP
NOP
READ A
NOP
WRITE B
NOP
NOP
DQM
DIN B0
DIN B1
DIN B2
t
CK1,
I/O
’
s
CAS latency = 2
t
CK2,
I/O
’
s
CAS latency = 3
CLK
T0
T2
T1
T3
T4
T5
T6
T7
T8
DOUT A0
OMMAND
DIN B0
DIN B1
DIN B2
DOUT A1
DOUT A0
Must be Hi-Z before
the Write Command
t
DQZ
t
DQW
:
“
H
”
or
“
L
”
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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