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參數(shù)資料
| 型號(hào)： | V54C3128164VBGA |
| 廠(chǎng)商： | Mosel Vitelic, Corp. |
| 英文描述： | 128Mbit SDRAM 3.3 VOLT, BGA PACKAGE |
| 中文描述： | 128Mbit SDRAM的3.3伏，BGA封裝 |
| 文件頁(yè)數(shù)： | 18/45頁(yè) |
| 文件大?。?/td> | 871K |
| 代理商： | V54C3128164VBGA |
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18
V54C3128(16/80/40)4V(BGA) Rev. 1.2 September 2001
MOSEL VITELIC
V54C3128(16/80/40)4V(BGA)
3. Read Interrupted by a Read
(Burst Length = 4, CAS latency = 2, 3)
4.1 Read to Write Interval
(Burst Length = 4, CAS latency = 3)
COMMAND
READ A
READ B
NOP
NOP
NOP
NOP
NOP
NOP
t
CK2,
I/O
’
s
CAS latency = 2
t
CK3,
I/O
’
s
CAS latency = 3
NOP
CLK
T0
T2
T1
T3
T4
T5
T6
T7
T8
DOUT B
0
DOUT B
1
DOUT B
2
DOUT B
3
DOUT A
0
DOUT B
0
DOUT B
1
DOUT B
2
DOUT B
3
DOUT A
0
COMMAND
NOP
READ A
NOP
NOP
NOP
NOP
WRITE B
NOP
NOP
DQM
DOUT A0
DIN B0
DIN B1
DIN B2
Must be Hi-Z before
the Write Command
I/O
’
s
Minimum delay between the Read and Write Commands = 4+1 = 5 cycles
CLK
T0
T2
T1
T3
T4
T5
T6
T7
T8
t
DQZ
t
DQW
:
“
H
”
or
“
L
”
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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| V54C3128164VT | 制造商:MOSEL 制造商全稱(chēng):MOSEL 功能描述:128Mbit SDRAM 3.3 VOLT, TSOP II / SOC PACKAGE 8M X 16, 16M X 8, 32M X 4 |
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