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參數(shù)資料
| 型號： | UPSD3434EV |
| 廠商： | 意法半導體 |
| 英文描述： | Turbo Plus Series Fast Turbo 8032 MCU with USB and Programmable Logic(帶有USB和可編程邏輯的Turbo Plus系列快速Turbo 8032 MCU) |
| 中文描述： | Turbo Plus系列高速渦輪8032 USB和可編程邏輯（帶有的USB和可編程邏輯的渦輪加系列快速渦輪8032單片機微控制器） |
| 文件頁數(shù)： | 242/293頁 |
| 文件大?。?/td> | 4624K |
| 代理商： | UPSD3434EV |
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PSD module
uPSD34xx
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to achieve this memory standby mode when no inputs are changing—it happens
automatically. Thus, the slower the 8032 clock, the lower the current consumption.
Both PLDs (DPLD and GPLD) are also zero-power, but this is not the default condition.
The 8032 must set a bit in one of the csiop PMMR registers at run-time to achieve zero-
power.
Automatic Power-Down (APD):
The APD feature allows the PSD Module to reach its
lowest current consumption levels. If enabled, the APD counter will time-out when there
is a lack of 8032 bus activity for an extended amount of time (8032 asleep). After time-
out occurs, all 8032 address and data buffers on the PSD Module are shut down,
preventing the PSD Module memories and potentially the PLDs from waking up from
standby, even if address inputs are changing state because of noise or any external
components driving the address lines. Since the actual address and data buffers are
turned off, current consumption is even further reduced.
●
Note:
Non-address signals are still available to PLD inputs and will wake up the PLDs if these
signals are changing state, but will not wake up the memories.
The APD counter requires a relatively slow external clock input on pin PD1 that does
stop when the 8032 goes to sleep mode.
Forced Power-Down (FPD):
The MCU can put the PSD Module into Power-Down
mode with the same results as using APD described above, but FPD does not rely on
the APD counter. Instead, FPD will force the PSD Module into Power-Down mode when
the MCU firmware sets a bit in one of the csiop PMMR registers. This is a good
alternative to APD because no external clock is needed for the APD counter.
PSD Module Chip Select Input (CSI):
This input on pin PD2 (80-pin devices only) can
be used to disable the internal memories, placing them in standby mode even if
address inputs are changing. This feature does not block any internal signals (the
address and data buffers are still on but signals are ignored) and CSI does not disable
the PLDs. This is a good alternative to using the APD counter, which requires an
external clock on pin PD1.
Non-Turbo Mode:
The PLDs can operate in Turbo or non-Turbo modes. Turbo mode
has the shortest signal propagation delay, but consumes more current than non-Turbo
mode. A csiop register can be written by the 8032 to select modes, the default mode is
with Turbo mode enabled. In non-Turbo mode, the PLDs can achieve very low standby
current (~ zero DC current) while no PLD inputs are changing, and the PLDs will even
use less AC current when inputs do change compared to Turbo mode.
When the Turbo mode is enabled, there is a significant DC current component AND the
AC current component is higher than non-Turbo mode, as shown in
Figure 96 on
page 259
(5V) and
Figure 97 on page 260
(3.3V).
Blocking Bits:
Significant power savings can be achieved by blocking 8032 bus control
signals (RD, WR, PSEN, ALE) from reaching PLD inputs, if these signals are not used
in any PLD equations. Blocking is achieved by the 8032 writing to the “blocking bits” in
csiop PMMR registers. Current consumption of the PLDs is directly related to the
composite frequency of all transitions on PLD inputs, so blocking certain PLD inputs
can significantly lower PLD operating frequency and power consumption (resulting in a
lower frequency on the graphs of
Figure 96 on page 259
and
Figure 97 on page 260
).
SRAM Backup Voltage:
Pin PC2 can be configured in PSDsoft to accept an alternate
DC voltage source (battery) to automatically retain the contents of SRAM when V
DD
drops below this alternate voltage.
●
●
●
●
●
Note:
It is recommended to prevent unused inputs from floating on Ports A, B, C, and D by pulling
them up to V
DD
with a weak external resistor (100K
), or by setting the csiop Direction
相關PDF資料 |
PDF描述 |
|---|---|
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參數(shù)描述 |
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| UPSD3434EV-40U6 | 功能描述:8位微控制器 -MCU 8 BITS MICROCONTR RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風格:SMD/SMT |
| UPSD3434EVB40T6 | 功能描述:8位微控制器 -MCU uPSD34x Turbo Plus Fast Turbo 8032 MCU RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風格:SMD/SMT |
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