參數(shù)資料
型號： UPSD33XX
廠商： 意法半導(dǎo)體
英文描述： Fast 8032 MCU with Programmable Logic
中文描述： 8032微控制器的快速可編程邏輯
文件頁數(shù)： 167/231頁
文件大?。?/td> 1805K
代理商： UPSD33XX
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uPSD33xx
Figure 68. Detail of a Single IMC
Table 90. Input Macrocell Port A
(1)
(address = csiop + offset 0Ah)
Note: 1. Port A not available on 52-pin uPSD33xx devices
2. 1 = current state of IMC is logic '1,' 0 = current state is logic ’0’
Table 91. Input Macrocell Port B (address = csiop + offset 0Bh)
Note: 1 = current state of IMC is logic '1,' 0 = current state is logic ’0’
Table 92. Input Macrocell Port C (address = csiop + offset 18h)
Note: 1. X = Not guaranteed value, can be read either '1' or '0.' These are JTAG pins.
2. 1 = current state of IMC is logic '1,' 0 = current state is logic ’0’
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
IMC PA7
IMC PA6
IMC PA5
IMC PA4
IMC PA3
IMC PA2
IMC PA1
IMC PA0
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
IMC PB7
IMC PB6
IMC PB5
IMC PB4
IMC PB3
IMC PB2
IMC PB1
IMC PB0
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
IMC PC7
X
X
IMC PC4
IMC PC3
IMC PC2
X
X
INPUT MACROCELL (IMC)
D
Q
(.LE)
G
D
Q
(.LD)
M
U
X
M
U
X
PSDsoft
8032 DATA BIT
8032 READ OF PARTICULAR CSIOP IMC REGISTER
PT CLOCK OR GATE (.LD OR .LE)
PIN INPUT
LATCHED INPUT
GATED INPUT
ALE
PSDsoft
ALE
8
FROM I/O PORT
LOGIC
INPUT SIGNAL
FROM PIN ON
PORT A, B, or C
FROM AND-OR ARRAY
TO PLD INPUT BUS
THIS SIGAL IS GANGED TO 3 OTHER
IMCs, GROUPING IMC 0 - 3 or IMC 4 - 7.
AI06603A
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PDF描述
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