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參數資料
| 型號： | UPD78F9512GR-JJG-A |
| 廠商： | Renesas Electronics America |
| 文件頁數： | 160/175頁 |
| 文件大?。?/td> | 0K |
| 描述： | MCU 8BIT SGL CHIP 16PIN |
| 標準包裝： | 400 |
| 系列： | 78K0S/Kx1+ |
| 核心處理器： | 78K0S |
| 芯體尺寸： | 8-位 |
| 速度： | 10MHz |
| 外圍設備： | LVD，POR，PWM，WDT |
| 輸入/輸出數： | 13 |
| 程序存儲器容量： | 4KB（4K x 8） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 128 x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 2 V ~ 5.5 V |
| 振蕩器型： | 內部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 16-SSOP（0.173"，4.40mm 寬） |
| 包裝： | 托盤 |
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CHAPTER 5 CLOCK GENERATORS
User’s Manual U16994EJ6V0UD
83
(a) The internal reset signal is generated by the power-on-clear function on power application, the option byte is
referenced after reset, and the system clock is selected.
(b) The option byte is referenced and the system clock is selected. Then the high-speed internal oscillation
clock operates as the system clock.
Figure 5-9. Status Transition of Default Start by High-Speed internal oscillation
HALT
instruction
STOP
instruction
VDD > 2.1 V (TYP.)
Start with PCC = 02H,
PPCC = 02H
HALT
STOP
Interrupt
Reset signal
Interrupt
Power
application
Reset by
power-on-clear
Clock division ratio
variable during
CPU operation
High-speed internal
oscillator selected
by option byte
Remark
PCC:
Processor clock control register
PPCC: Preprocessor clock control register
相關PDF資料 |
PDF描述 |
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| VI-J3B-IW-F4 | CONVERTER MOD DC/DC 95V 100W |
| VI-J3B-IW-F3 | CONVERTER MOD DC/DC 95V 100W |
相關代理商/技術參數 |
參數描述 |
|---|---|
| UPD78F9801GB-8ES-A | 制造商:Renesas Electronics Corporation 功能描述: |
| UPD78F9842GB-8ES | 制造商:Renesas Electronics Corporation 功能描述: |
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| UPD78F9852GB(A)-8ES | 制造商:Renesas Electronics Corporation 功能描述: |
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