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參數(shù)資料
| 型號(hào)： | UPD784224GK |
| 廠商： | NEC Corp. |
| 英文描述： | 16/8-BIT SINGLE-CHIP MICROCONTROLLERS |
| 中文描述： | 16/8-BIT單晶片微控制器 |
| 文件頁數(shù)： | 72/92頁 |
| 文件大小： | 687K |
| 代理商： | UPD784224GK |
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72
μ
PD784224, 784225, 784224Y, 784225Y
Data Sheet U12376EJ1V0DS00
Serial Operation (T
A
=
40
°
C to +85
°
C, V
DD
= V
DD0
= V
DD1
= AV
DD
= 1.8 to 5.5 V, V
SS
= V
SS0
= V
SS1
= AV
SS
= 0 V)
(a) 3-wire serial I/O mode (SCK: Internal clock output)
Parameter
Symbol
Conditions
MIN.
TYP.
MAX.
Unit
SCK cycle time
t
KCY1
2.7 V
≤
V
DD
≤
5.5 V
800
ns
3,200
ns
SCK high-/low-level
t
KH1
,
2.7 V
≤
V
DD
≤
5.5 V
350
ns
width
t
KL1
1,500
ns
SI setup time (to SCK
↑
)
t
SIK1
2.7 V
≤
V
DD
≤
5.5 V
10
ns
30
ns
SI hold time (from SCK
↑
)
t
KSI1
40
ns
SO output delay time
(from SCK
↓
)
t
KSO1
30
ns
(b) 3-wire serial I/O mode (SCK: External clock input)
Parameter
Symbol
Conditions
MIN.
TYP.
MAX.
Unit
SCK cycle time
t
KCY2
2.7 V
≤
V
DD
≤
5.5 V
800
ns
3,200
ns
SCK high-/low-level
t
KH2
2.7 V
≤
V
DD
≤
5.5 V
400
ns
width
t
KL2
1,600
ns
SI setup time (to SCK
↑
)
t
SIK2
2.7 V
≤
V
DD
≤
5.5 V
10
ns
30
ns
SI hold time (from SCK
↑
)
t
KSI2
40
ns
SO output delay time
(from SCK
↓
)
t
KSO2
30
ns
(c) UART mode
Parameter
Symbol
Conditions
MIN.
TYP.
MAX.
Unit
ASCK cycle time
t
KCY3
4.5 V
≤
V
DD
≤
5.5 V
417
ns
2.7 V
≤
V
DD
< 4.5 V
833
ns
1,667
ns
ASCK high-/low-level
width
t
KH3
t
KL3
4.5 V
≤
V
DD
≤
5.5 V
208
ns
2.7 V
≤
V
DD
< 4.5 V
416
ns
833
ns
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PDF描述 |
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