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參數(shù)資料
| 型號(hào)： | uPD70F3102GJ-33-8EU |
| 廠商： | NEC Corp. |
| 英文描述： | 32-/16-BIT SINGLE-CHIP MICROCONTROLLER |
| 中文描述： | 32-/16-BIT單片機(jī) |
| 文件頁(yè)數(shù)： | 63/82頁(yè) |
| 文件大?。?/td> | 476K |
| 代理商： | UPD70F3102GJ-33-8EU |
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Preliminary Data Sheet U13844EJ2V0DS00
63
μ
PD70F3102-33
(h) DMA flyby transfer timing (external I/O
→
DRAM (EDO, high-speed page) transfer) (3/3)
TRPW
T1
TRHW
TW
T2
TDAW
T3
TCPW
TW
TO2
TDAW
TO1
<56>
<57>
<58>
<76>
<61>
<60>
<94>
<64>
<77>
<65>
<63>
<81>
<67>
<66>
<71>
<82>
<101>
<105>
<83>
<85>
<89>
<106>
<34>
<107>
<33>
<24>
<25>
<24>
<25>
<24>
Data
Data
<59>
<88>
<102>
<92>
<35>
<32>
<25>
CLKOUT (Output)
A0 to A23 (Output)
RASn (Output)
UCAS (Output)
LCAS (Output)
RD (Output)
OE (Output)
DMAAKm (Output)
WE (Output)
IOWR (Output)
IORD (Output)
D0 to D15 (I/O)
WAIT (Input)
BCYST (Output)
Row address
Column address
Column address
Remarks 1.
These timings are for the following cases (n = 0 to 3, xx = 00 to 03, 10 to 13):
Number of waits (TRPW) specified by RPCxx bit of register DRCn: 1
Number of waits (TRHW) specified by RHCxx bit of register DRCn: 1
Number of waits (TDAW) specified by DACxx bit of register DRCn: 1
Number of waits (TCPW) specified by CPCxx bit of register DRCn: 1
Number of waits inserted to source-side access during DMA flyby transfer: 0
2.
Broken lines indicate high impedance.
3.
n = 0 to 7, m = 0 to 3
相關(guān)PDF資料 |
PDF描述 |
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