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參數(shù)資料
| 型號： | UPD65549 |
| 英文描述： | CMOS Gate Array.Embedded Array Ver.2.0 for Package | Design Manual[05/2003] |
| 中文描述： | CMOS門陣列Array.Embedded的包版本2.0 |設(shè)計手冊[05/2003] |
| 文件頁數(shù)： | 2/64頁 |
| 文件大小： | 399K |
| 代理商： | UPD65549 |
第1頁當(dāng)前第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁
2
μ
PD64A, 65
Data Sheet U14380EJ2V0DS00
ORDERING INFORMATION
Part Number
μ
PD64AMC-
×××
-5A4
μ
PD65MC-
×××
-5A4
Package
20-pin plastic SSOP (300 mil)
20-pin plastic SSOP (300 mil)
Remark
×××
indicates ROM code suffix.
PIN CONFIGURATION (TOP VIEW)
20-pin Plastic SSOP (300 mil)
μ
PD64AMC-
×××
-5A4
μ
PD65MC-
×××
-5A4
Caution The pin numbers of K
I
and K
I/O
are in the reverse order of the
μ
PD6600A, and 6124A.
1
2
3
4
5
6
7
8
9
10
K
I/O6
K
I/O7
S
0
S
1
/LED
REM
V
DD
X
OUT
X
IN
GND
S
2
20
19
18
17
16
15
14
13
12
11
K
I/O5
K
I/O4
K
I/O3
K
I/O2
K
I/O1
K
I/O0
K
I3
K
I2
K
I1
K
I0
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| UPD65550 | CMOS-10HD Family Pamphlet | Pamphlet[07/2003] |
| UPD65551 | CMOS Gate Array.Embedded Array Ver.2.0 for Package | Design Manual[05/2003] |
| UPD65564 | CMOS-10HD Family Pamphlet | Pamphlet[07/2003] |
| UPD65565 | ANACONDA LT TRANSCEIVER |
| UPD65566 | CMOS-10HD Family Pamphlet | Pamphlet[07/2003] |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| UPD65550 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:CMOS-10HD Family Pamphlet | Pamphlet[07/2003] |
| UPD65551 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:CMOS Gate Array.Embedded Array Ver.2.0 for Package | Design Manual[05/2003] |
| UPD65564 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:CMOS-10HD Family Pamphlet | Pamphlet[07/2003] |
| UPD65565 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:CMOS Gate Array.Embedded Array Ver.2.0 for Package | Design Manual[05/2003] |
| UPD65566 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:CMOS-10HD Family Pamphlet | Pamphlet[07/2003] |
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