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參數(shù)資料
| 型號： | UPD17718 |
| 廠商： | NEC Corp. |
| 英文描述： | 4-BIT SINGLE-CHIP MICROCONTROLLERS WITH DEDICATED HARDWARE FOR DIGITAL TUNING SYSTEM |
| 中文描述： | 4位的單芯片專用數(shù)字調(diào)諧系統(tǒng)硬件微控制器 |
| 文件頁數(shù)： | 344/408頁 |
| 文件大小： | 1758K |
| 代理商： | UPD17718 |
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344
μ
PD17717, 17718, 17719
20.2 Halt Function
20.2.1 Outline of halt function
The halt function stops the operating clock of the CPU by executing the “HALT h” instruction.
When this instruction is executed, the program is stopped until the halt status is later released. Therefore, the
current consumption of the device in the halt status is reduced by the operating current of the CPU.
The halt status is released by using basic timer 0 carry FF, interrupt, or port input (P0D).
The release condition is specified by operand “h” of the “HALT h” instruction.
20.2.2 Halt status
In the halt status, all the operations of the CPU are stopped. In other words, execution of the program is stopped
at the “HALT h” instruction. However, the peripheral hardware units continue the operation specified before execution
of the “HALT h” instruction.
For the operation of each peripheral hardware unit, refer to
20.4 Device Operation in Halt and Clock Stop Status
.
20.2.3 Halt release condition
Figure 20-2 shows the halt release condition.
The halt release condition is specified by 4-bit data specified by operand “h” of the “HALT h” instruction.
The halt status is released when the condition specified by “1” in operand “h”.
When the halt status is released, program execution is started from the instruction after the “HALT h” instruction.
If the halt status is released by an interrupt, the operation to be performed after the halt status has been released
differs depending on whether the interrupts are enabled (EI status) or disabled (DI status) when an interrupt source
(IRQxxx = 1) is issued with the interrupt (IPxxx = 1) enabled.
If two or more releasing conditions are specified, the halt status is released when one of the specified condition
is satisfied.
If 0000B is set as halt release condition “h”, no releasing condition is set. If the device is reset (by means of power-
ON reset, WDT&SP reset, or CE reset) at this time, the halt status is released.
Figure 20-2. Halt Release Condition
Operand
HALT h (4 bits)
b
3
b
2
b
1
b
0
0
1
Released when high level is input to port 0D
Released when basic timer 0 carry FF is set to 1
Undefined (Fix this bit to “0”.)
Released when interrupt is accepted
Not released even if condition is satisfied
Released if condition is satisfied
Sets halt status releasing condition
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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| UPD17719 | 制造商:NEC 制造商全稱:NEC 功能描述:4-BIT SINGLE-CHIP MICROCONTROLLERS WITH DEDICATED HARDWARE FOR DIGITAL TUNING SYSTEM |
| UPD17719GC | 制造商:NEC 制造商全稱:NEC 功能描述:4-BIT SINGLE-CHIP MICROCONTROLLERS WITH DEDICATED HARDWARE FOR DIGITAL TUNING SYSTEM |
| UPD17719GC-XXX-3B9 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:MICROCONTROLLER|4-BIT|UPD17K CPU|CMOS|QFP|80PIN|PLASTIC |
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