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參數(shù)資料
| 型號： | TMX320DM6437BZDUA |
| 廠商： | Texas Instruments, Inc. |
| 英文描述： | Digital Media Processor |
| 中文描述： | 數(shù)字媒體處理器 |
| 文件頁數(shù)： | 62/309頁 |
| 文件大?。?/td> | 2216K |
| 代理商： | TMX320DM6437BZDUA |
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www.ti.com
P
TMS320DM6437
Digital Media Processor
SPRS345B–NOVEMBER 2006–REVISED MARCH 2007
Table 2-24. Multichannel Audio Serial Port (McASP0) Terminal Functions
SIGNAL
TYPE
(1)
OTHER
(2)(3)
DESCRIPTION
ZWT
NO.
ZDU
NO.
NAME
McASP0
This pin is multiplexed between McASP0, McBSP1, and GPIO.
For McASP0, it is McASP0 mute input AMUTEIN0 (I).
This pin is multiplexed between McASP0, McBSP1, and GPIO.
For McASP0, it is McASP0 mute output AMUTE0 (O/Z).
This pin is multiplexed between McASP0, McBSP0, and GPIO.
For McASP0, it is McASP0 receive bit clock ACLKR0 (I/O/Z).
This pin is multiplexed between McASP0, McBSP0, and GPIO.
For McASP0, it is McASP0 receive high-frequency master clock
AHCLKR0 (I/O/Z).
This pin is multiplexed between McASP0, McBSP1, and GPIO.
For McASP0, it is McASP0 transmit bit clock ACLKX0 (I/O/Z).
This pin is multiplexed between McASP0, McBSP1, and GPIO.
For McASP0, it is McASP0 transmit high-frequency master clock
AHCLKX0 (I/O/Z).
This pin is multiplexed between McASP0, McBSP0, and GPIO.
For McASP0, it is McASP0 receive frame synchronization AFSX0
(I/O/Z).
This pin is multiplexed between McASP0, McBSP1, and GPIO.
For McASP0, it is McASP0 transmit frame synchronization AFSR0
(I/O/Z).
This pin is multiplexed between McASP0, McBSP0, and GPIO.
For McASP0, it is McASP0 transmit/receive (TX/RX) data pin 3
AXR0[3] (I/O/Z).
This pin is multiplexed between McASP0, McBSP0, and GPIO.
For McASP0, it is McASP0 transmit/receive (TX/RX) data pin 2
AXR0[2] (I/O/Z).
This pin is multiplexed between McASP0, McBSP0, and GPIO.
For McASP0, it is McASP0 transmit/receive (TX/RX) data pin 1
AXR0[1] (I/O/Z).
This pin is multiplexed between McASP0, McBSP1, and GPIO.
For McASP0, it is McASP0 transmit/receive (TX/RX) data pin 0
AXR0[0] (I/O/Z).
AMUTEIN0/FSX1/
GP[109]
AMUTE0/DR1/
GP[110]
ACLKR0/CLKX0/
GP[99]
IPD
DV
DD33
IPD
DV
DD33
IPD
DV
DD33
F2
G3
I/O/Z
G3
H3
I/O/Z
H1
J1
I/O/Z
AHCLKR0/CLKR0/
GP[101]
IPD
DV
DD33
J2
K1
I/O/Z
ACLKX0/CLKX1/
GP[106]
IPD
DV
DD33
F1
G1
I/O/Z
AHCLKX0/CLKR1/
GP[108]
IPD
DV
DD33
G1
H1
I/O/Z
AFSR0/DR0/
GP[100]
IPD
DV
DD33
H4
K3
I/O/Z
AFSX0/DX1/
GP[107]
IPD
DV
DD33
G2
G2
I/O/Z
AXR0[3]/FSR0/
GP[102]
IPD
DV
DD33
G4
J3
I/O/Z
AXR0[2]/FSX0/
GP[103]
IPD
DV
DD33
H3
J2
I/O/Z
AXR0[1]/DX0/
GP[104]
IPD
DV
DD33
J3
K2
I/O/Z
AXR0[0]/FSR1/
GP[105]
IPD
DV
DD33
H2
H2
I/O/Z
(1)
(2)
I = Input, O = Output, Z = High impedance, S = Supply voltage, GND = Ground, A = Analog signal
IPD = Internal pulldown, IPU = Internal pullup. For more detailed information on pullup/pulldown resistors and situations where external
pullup/pulldown resistors are required, see
Section 3.9.1
,
Pullup/Pulldown Resistors
.
Specifies the operating I/O supply voltage for each signal
(3)
Device Overview
62
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相關(guān)PDF資料 |
PDF描述 |
|---|---|
| TMX320DM6437BZWTA | Digital Media Processor |
| TMS320DM6443_07 | Digital Media System-on-Chip |
| TMX320DM6443AZWT | Digital Media System-on-Chip |
| TMX320DM6443ZWT | Digital Media System-on-Chip |
| TMS320DM647_08 | Digital Media Processor |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| TMX320DM6437BZWTA | 功能描述:數(shù)字信號處理器和控制器 - DSP, DSC Dig Media Processor RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時(shí)鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時(shí)器數(shù)量:3 設(shè)備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風(fēng)格:SMD/SMT |
| TMX320DM6441CZWT | 制造商:Texas Instruments 功能描述: |
| TMX320DM6441DZWT | 制造商:Texas Instruments 功能描述:DAVINCI DIGITAL MEDIA SYSTEM-ON-CHIP - Tape and Reel |
| TMX320DM6443AZWT | 制造商:Rochester Electronics LLC 功能描述:DAVINCI DIGITAL MEDIA SYSTEM-ON-CHIP - Tape and Reel |
| TMX320DM6443BZWT | 制造商:Texas Instruments 功能描述: |
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