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參數(shù)資料
| 型號(hào)： | TEA6880 |
| 廠商： | NXP Semiconductors N.V. |
| 英文描述： | ECONOLINE: RB & RA - Dual Output from a Single Input Rail- Power Sharing on Output- Industry Standard Pinout- 1kVDC & 2kVDC Isolation- Custom Solutions Available- UL94V-0 Package Material- Efficiency to 85% |
| 中文描述： | 截至級(jí)車(chē)電臺(tái)模擬信號(hào)處理器支持核心計(jì)劃 |
| 文件頁(yè)數(shù)： | 48/88頁(yè) |
| 文件大?。?/td> | 328K |
| 代理商： | TEA6880 |
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2000 May 08
48
Philips Semiconductors
Product specification
Up-level Car radio Analog Signal
Processor (CASP)
TEA6880H
11.7
Write mode: subaddress 3H
Table 28
Format of data byte Alignment 3 (ALGN3)
Table 29
Description of ALGN3 bits
Table 30
Setting of noise blanker sensitivity
Table 31
Setting of alignment for start of high cut control (
α
10kHz
= 3 dB)
7
6
5
4
3
2
1
0
NBS1
NBS0
DE75
HCCS
HST1
HST0
HSL1
HSL0
BIT
SYMBOL
DESCRIPTION
7
6
5
NBS1
NBS0
DE75
Noise blanker sensitivity.
These 2 bits determine the noise blanker sensitivity levels;
see Table 30.
De-emphasis.
If DE75 = 1, then de-emphasis is 75
μ
s. If DE75 = 1, then de-emphasis
is 50
μ
s.
HCC control switch.
With static roll-off: HCCS = 1, C
61
= C
62
= 2.7 nF. Without static
roll-off: HCCS = 0, C
61
= C
62
= 680 pF.
HCC start alignment.
These 2 bits determine the alignment for the start of high cut
control; see Table 31 and Fig.10.
4
HCCS
3
2
1
0
HST1
HST0
HSL1
HSL0
HCC slope alignment.
These 2 bits determine the alignment for the slope of high cut
control; see Table 32 and Fig.11.
V
pulse(p)(MPX)
(mV) V
pulse(p)(level)
(mV)
12
24
60
120
NBS1
NBS0
110
120
150
200
1
1
0
0
1
0
1
0
V
(3-10)DC
(V)
1.30
1.45
1.90
2.10
HST1
HST0
1
1
0
0
1
0
1
0
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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