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參數(shù)資料
| 型號(hào)： | STK6005 |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | converting PC / Mac video images for a TFT-LCD display monitor |
| 中文描述： | 轉(zhuǎn)換電腦/蘋果的視頻圖像的TFT液晶顯示屏 |
| 文件頁數(shù)： | 10/36頁 |
| 文件大?。?/td> | 391K |
| 代理商： | STK6005 |
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STK6005
5. FUNCTION
5.1 Input Timing and Format
This chip supports a 24-bit RGB input (up to SXGA 75Hz) of a single port, a 16-bit YUV 4:2:2 input,
and an 8-bit YUV 4:2:2 (CCIR-656) video input. The timing diagrams are provided below.
For RGB input format, the RGB data (RIN/GIN/BIN ports) and H-Sync (HSI), V-Sync (VSI) are
sampled at the rising or falling edge of VCLK.
For TMDS input format, a control signal ExtDE can be provided to define the valid data.
For video input format, the input YUV ports are shared with RIN/GIN/BIN ports. The 16-bit YUV 4:2:2
format uses RIN[7:0] for Y[7:0], GIN[7:0] for UV[7:0], and BIN[7:1] for YUV control bus. Hsync / Vsync
are used as H-Sync and V-Sync input signals. Cref is used as a clock edge qualifier. Href and Vref are
used to define the valid data. Field input is used as the odd / even fields indicator.
The 8-bit YUV 4:2:2 (CCIR-656) format uses RIN[7:0] for data input YUV[7:0], and the timing control is
also embedded in the data stream. Therefore, there are no control signal connections needed for this
format.
VCLK
R/G/BIN RGB0 RGB1 RGB2
HSI/VSI
ExtDE
RGB input format timing diagram
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相關(guān)PDF資料 |
PDF描述 |
|---|---|
| STK6005F | converting PC / Mac video images for a TFT-LCD display monitor |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| STK6005F | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:converting PC / Mac video images for a TFT-LCD display monitor |
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