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參數(shù)資料
| 型號： | ST72F561K9TAS |
| 廠商： | STMICROELECTRONICS |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PQFP32 |
| 封裝： | 7 X 7 MM, ROHS COMPLIANT, LQFP-32 |
| 文件頁數(shù)： | 80/280頁 |
| 文件大?。?/td> | 2307K |
| 代理商： | ST72F561K9TAS |
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LINSCI serial communication interface (LIN master/slave)
ST72561-Auto
170/280
Doc ID 12370 Rev 7
Bit 5 = SCID Disabled for low power consumption
When this bit is set the SCI prescalers and outputs are stopped and the end of the current
byte transfer in order to reduce power consumption.This bit is set and cleared by software.
0: SCI enabled
1: SCI prescaler and outputs disabled
Bit 4 = M Word length.
This bit determines the word length. It is set or cleared by software.
0: 1 start bit, 8 data bits, 1 stop bit
1: 1 start bit, 9 data bits, 1 stop bit
Note:
The M bit must not be modified during a data transfer (both transmission and reception).
Bit 3 = WAKE Wake-Up method.
This bit determines the SCI Wake-Up method, it is set or cleared by software.
0: idle line
1: address mark
Note:
If the LINE bit is set, the WAKE bit is deactivated and replaced by the LHDM bit.
Bit 2 = PCE Parity control enable.
This bit is set and cleared by software. It selects the hardware parity control (generation and
detection for byte parity, detection only for LIN parity).
0: parity control disabled
1: parity control enabled
Bit 1 = PS Parity selection.
This bit selects the odd or even parity when the parity generation/detection is enabled (PCE
bit set). It is set and cleared by software. The parity will be selected after the current byte.
0: even parity
1: odd parity
Bit 0 = PIE Parity interrupt enable.
This bit enables the interrupt capability of the hardware parity control when a parity error is
detected (PE bit set). The parity error involved can be a byte parity error (if bit PCE is set
and bit LPE is reset) or a LIN parity error (if bit PCE is set and bit LPE is set).
0: parity error interrupt disabled
1: parity error interrupt enabled
15.8.3
Control register 2 (SCICR2)
Read/ write
Reset value: 0000 0000 (00h)
Bit 7 = TIE Transmitter interrupt enable.
This bit is set and cleared by software.
0: interrupt is inhibited
1: in SCI interrupt is generated whenever TDRE = 1 in the SCISR register
7
0
TIE
TCIE
RIE
ILIE
TE
RE
RWU(1)
1.
This bit has a different function in LIN mode, please refer to the LIN mode register description.
SBK(1)
相關PDF資料 |
PDF描述 |
|---|---|
| ST72P561J9TC/XXXXE | 8-BIT, MROM, 8 MHz, MICROCONTROLLER, PQFP44 |
| ST72P561K6TA/XXXS | 8-BIT, MROM, 8 MHz, MICROCONTROLLER, PQFP32 |
| ST72P561R9TC/XXXRE | 8-BIT, MROM, 8 MHz, MICROCONTROLLER, PQFP64 |
| ST72561AR4TA/XXXXE | 8-BIT, MROM, 8 MHz, MICROCONTROLLER, PQFP64 |
| ST72561K4TC/XXXE | 8-BIT, MROM, 8 MHz, MICROCONTROLLER, PQFP32 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| ST72F561K9TATR | 功能描述:8位微控制器 -MCU 8-bit MCU Flash RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風格:SMD/SMT |
| ST72F561K9TATRE | 制造商:STMicroelectronics 功能描述: |
| ST72F561K9TBE | 制造商:STMicroelectronics 功能描述: |
| ST72F561K9TBTXE | 制造商:STMicroelectronics 功能描述: |
| ST72F561K9TC | 功能描述:8位微控制器 -MCU Flash 60K SPI/2SCI/C RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風格:SMD/SMT |
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