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參數(shù)資料
| 型號(hào)： | ST72F561K9TAS |
| 廠商： | STMICROELECTRONICS |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PQFP32 |
| 封裝： | 7 X 7 MM, ROHS COMPLIANT, LQFP-32 |
| 文件頁數(shù)： | 58/280頁 |
| 文件大小： | 2307K |
| 代理商： | ST72F561K9TAS |
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Serial peripheral interface (SPI)
ST72561-Auto
150/280
Doc ID 12370 Rev 7
Clearing the MODF bit is done through a software sequence:
1.
A read access to the SPICSR register while the MODF bit is set.
2.
A write to the SPICR register.
Note:
To avoid any conflicts in an application with multiple slaves, the SS pin must be pulled high
during the MODF bit clearing sequence. The SPE and MSTR bits may be restored to their
original state during or after this clearing sequence.
Hardware does not allow the user to set the SPE and MSTR bits while the MODF bit is set
except in the MODF bit clearing sequence.
In a slave device, the MODF bit can not be set, but in a multimaster configuration the device
can be in slave mode with the MODF bit set.
The MODF bit indicates that there might have been a multimaster conflict and allows
software to handle this using an interrupt routine and either perform a reset or return to an
application default state.
14.5.2
Overrun condition (OVR)
An overrun condition occurs when the master device has sent a data byte and the slave
device has not cleared the SPIF bit issued from the previously transmitted byte.
When an Overrun occurs:
●
The OVR bit is set and an interrupt request is generated if the SPIE bit is set.
In this case, the receiver buffer contains the byte sent after the SPIF bit was last cleared. A
read to the SPIDR register returns this byte. All other bytes are lost.
The OVR bit is cleared by reading the SPICSR register.
14.5.3
Write collision error (WCOL)
A write collision occurs when the software tries to write to the SPIDR register while a data
transfer is taking place with an external device. When this happens, the transfer continues
uninterrupted and the software write will be unsuccessful.
Write collisions can occur both in master and slave mode. See also Slave select
management.
Note:
A "read collision" will never occur since the received data byte is placed in a buffer in which
access is always synchronous with the CPU operation.
The WCOL bit in the SPICSR register is set if a write collision occurs.
No SPI interrupt is generated when the WCOL bit is set (the WCOL bit is a status flag only).
Clearing the WCOL bit is done through a software sequence (see Figure 75).
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| ST72P561J9TC/XXXXE | 8-BIT, MROM, 8 MHz, MICROCONTROLLER, PQFP44 |
| ST72P561K6TA/XXXS | 8-BIT, MROM, 8 MHz, MICROCONTROLLER, PQFP32 |
| ST72P561R9TC/XXXRE | 8-BIT, MROM, 8 MHz, MICROCONTROLLER, PQFP64 |
| ST72561AR4TA/XXXXE | 8-BIT, MROM, 8 MHz, MICROCONTROLLER, PQFP64 |
| ST72561K4TC/XXXE | 8-BIT, MROM, 8 MHz, MICROCONTROLLER, PQFP32 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| ST72F561K9TATR | 功能描述:8位微控制器 -MCU 8-bit MCU Flash RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時(shí)鐘頻率:50 MHz 程序存儲(chǔ)器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT |
| ST72F561K9TATRE | 制造商:STMicroelectronics 功能描述: |
| ST72F561K9TBE | 制造商:STMicroelectronics 功能描述: |
| ST72F561K9TBTXE | 制造商:STMicroelectronics 功能描述: |
| ST72F561K9TC | 功能描述:8位微控制器 -MCU Flash 60K SPI/2SCI/C RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時(shí)鐘頻率:50 MHz 程序存儲(chǔ)器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT |
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