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參數(shù)資料
| 型號： | ST72F561K9TAS |
| 廠商： | STMICROELECTRONICS |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PQFP32 |
| 封裝： | 7 X 7 MM, ROHS COMPLIANT, LQFP-32 |
| 文件頁數(shù)： | 110/280頁 |
| 文件大?。?/td> | 2307K |
| 代理商： | ST72F561K9TAS |
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LINSCI serial communication interface (LIN master only)
ST72561-Auto
198/280
Doc ID 12370 Rev 7
Character transmission
During an SCI transmission, data shifts out least significant bit first on the TDO pin. In this
mode, the SCIDR register consists of a buffer (TDR) between the internal bus and the
transmit shift register (see Figure 89).
Procedure
●
Select the M bit to define the word length.
●
Select the desired baud rate using the SCIBRR and the SCIETPR registers.
●
Set the TE bit to send an idle frame as first transmission.
●
Access the SCISR register and write the data to send in the SCIDR register (this
sequence clears the TDRE bit). Repeat this sequence for each data to be transmitted.
Clearing the TDRE bit is always performed by the following software sequence:
1.
An access to the SCISR register
2.
A write to the SCIDR register
The TDRE bit is set by hardware and it indicates:
●
The TDR register is empty.
●
The data transfer is beginning.
●
The next data can be written in the SCIDR register without overwriting the previous
data.
This flag generates an interrupt if the TIE bit is set and the I bit is cleared in the CCR
register.
When a transmission is taking place, a write instruction to the SCIDR register stores the
data in the TDR register and which is copied in the shift register at the end of the current
transmission.
When no transmission is taking place, a write instruction to the SCIDR register places the
data directly in the shift register, the data transmission starts, and the TDRE bit is
immediately set.
When a frame transmission is complete (after the stop bit or after the break frame) the TC
bit is set and an interrupt is generated if the TCIE is set and the I bit is cleared in the CCR
register.
Clearing the TC bit is performed by the following software sequence:
1.
An access to the SCISR register
2.
A write to the SCIDR register
Note:
The TDRE and TC bits are cleared by the same software sequence.
Break characters
Setting the SBK bit loads the shift register with a break character. The break frame length
depends on the M bit (see Figure 89).
As long as the SBK bit is set, the SCI send break frames to the TDO pin. After clearing this
bit by software the SCI insert a logic 1 bit at the end of the last break frame to guarantee the
recognition of the start bit of the next frame.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| ST72P561J9TC/XXXXE | 8-BIT, MROM, 8 MHz, MICROCONTROLLER, PQFP44 |
| ST72P561K6TA/XXXS | 8-BIT, MROM, 8 MHz, MICROCONTROLLER, PQFP32 |
| ST72P561R9TC/XXXRE | 8-BIT, MROM, 8 MHz, MICROCONTROLLER, PQFP64 |
| ST72561AR4TA/XXXXE | 8-BIT, MROM, 8 MHz, MICROCONTROLLER, PQFP64 |
| ST72561K4TC/XXXE | 8-BIT, MROM, 8 MHz, MICROCONTROLLER, PQFP32 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| ST72F561K9TATRE | 制造商:STMicroelectronics 功能描述: |
| ST72F561K9TBE | 制造商:STMicroelectronics 功能描述: |
| ST72F561K9TBTXE | 制造商:STMicroelectronics 功能描述: |
| ST72F561K9TC | 功能描述:8位微控制器 -MCU Flash 60K SPI/2SCI/C RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時(shí)鐘頻率:50 MHz 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT |
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