REV. 5.0.3 2.90V TO 5.5V UART WITH 32-BYTE FIFO TABLE 8: UART CONFI" />
參數(shù)資料
型號： ST16C650ACJ44TR-F
廠商： Exar Corporation
文件頁數(shù)： 16/50頁
文件大?。?/td> 0K
描述： IC UART FIFO 32B 44PLCC
標準包裝： 500
特點： *
通道數(shù)： 1，UART
FIFO's： 32 字節(jié)
規(guī)程： 打印機，RS232，RS422，RS485
電源電壓： 2.9 V ~ 5.5 V
帶并行端口： 是
帶IrDA 編碼器/解碼器： 是
帶故障啟動位檢測功能： 是
帶調(diào)制解調(diào)器控制功能： 是
帶CMOS： 是
安裝類型： 表面貼裝
封裝/外殼： 44-LCC（J 形引線）
供應商設備封裝： 44-PLCC（16.59x16.59）
包裝： 帶卷 (TR)
ST16C650A
23
REV. 5.0.3
2.90V TO 5.5V UART WITH 32-BYTE FIFO
TABLE 8: UART CONFIGURATION REGISTERS DESCRIPTION. SHADED BITS ARE ENABLED WHEN EFR BIT-4=1.
ADDRESS
A2-A0
REG
NAME
READ/
WRITE
BIT-7
BIT-6
BIT-5
BIT-4
BIT-3
BIT-2
BIT-1
BIT-0
COMMENT
16C550 Compatible Registers
0 0 0
RHR
RD
Bit-7
Bit-6
Bit-5
Bit-4
Bit-3
Bit-2
Bit-1
Bit-0
LCR[7] = 0
0 0 0
THR
WR
Bit-7
Bit-6
Bit-5
Bit-4
Bit-3
Bit-2
Bit-1
Bit-0
0 0 1
IER
RD/WR
0/
Modem
Stat.
Int.
Enable
RX Line
Stat.
Int.
Enable
TX
Empty
Int
Enable
RX
Data
Int.
Enable
CTS Int.
Enable
RTS Int.
Enable
Xoff Int.
Enable
Sleep
Mode
Enable
0 1 0
ISR
RD
FIFOs
Enabled
FIFOs
Enabled
0/
INT
Source
Bit-3
INT
Source
Bit-2
INT
Source
Bit-1
INT
Source
Bit-0
INT
Source
Bit-5
INT
Source
Bit-4
0 1 0
FCR
WR
RXFIFO
Trigger
RXFIFO
Trigger
0/
DMA
Mode
Enable
TX
FIFO
Reset
RX
FIFO
Reset
FIFOs
Enable
TXFIFO
Trigger
TXFIFO
Trigger
0 1 1
LCR
RD/WR Divisor
Enable
Set TX
Break
Set Par-
ity
Even
Parity
Enable
Stop
Bits
Word
Length
Bit-1
Word
Length
Bit-0
1 0 0
MCR
RD/WR
0/
Internal
Loop-
back
Enable
OP2#/
IRQn
Output
Enable
OP1#
RTS#
Output
Control
DTR#
Output
Control
LCR[7]=0
BRG
Pres-
caler
IR Mode
ENable
INT Type
Select
1 0 1
LSR
RD
RX FIFO
Error
TSR
Empty
THR
Empty
RX
Break
RX
Fram-
ing
Error
RX
Parity
Error
RX
Data
Over-
run
Error
RX
Data
Ready
XFR
WR
Rsrvd
Invert
RS485
Control
Output
Enable
XonAny
LSR
INT
Mode
Auto
RS485
Enable
Invert
IR RX
Input
Enable
Half-
duplex
IR
1 1 0
MSR
RD
CD
RI
DSR
CTS
Delta
CD#
Delta
RI#
Delta
DSR#
Delta
CTS#
IRPW
WR
Bit-7
Bit-6
Bit-5
Bit-4
Bit-3
Bit-2
Bit-1
Bit-0
1 1 1
SPR
RD/WR
Bit-7
Bit-6
Bit-5
Bit-4
Bit-3
Bit-2
Bit-1
Bit-0
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