參數(shù)資料
型號: SPAKMC332GMPV16
廠商: FREESCALE SEMICONDUCTOR INC
元件分類: 微控制器/微處理器
英文描述: 32-BIT, 16 MHz, MICROCONTROLLER, PQFP132
封裝: PLASTIC, QFP-132
文件頁數(shù): 146/265頁
文件大?。?/td> 6905K
代理商: SPAKMC332GMPV16
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MC68332
NOMENCLATURE
USER’S MANUAL
2-5
2.5 Conventions
Logic level one
is the voltage that corresponds to a Boolean true (1) state.
Logic level zero
is the voltage that corresponds to a Boolean false (0) state.
Set
refers specifically to establishing logic level one on a bit or bits.
Clear
refers specifically to establishing logic level zero on a bit or bits.
Asserted
means that a signal is in active logic state. An active low signal changes
from logic level one to logic level zero when asserted, and an active high signal chang-
es from logic level zero to logic level one.
Negated
means that an asserted signal changes logic state. An active low signal
changes from logic level zero to logic level one when negated, and an active high sig-
nal changes from logic level one to logic level zero.
A specific mnemonic
within a range is referred to by mnemonic and number. A15 is
bit 15 of accumulator A; ADDR7 is line 7 of the address bus; CSOR0 is chip-select op-
tion register 0. A range of mnemonics is referred to by mnemonic and the numbers
that define the range. AM[35:30] are bits 35 to 30 of accumulator M; CSOR[0:5] are
the first six option registers
Parentheses
are used to indicate the content of a register or memory location, rather
than the register or memory location itself. (A) is the content of accumulator A. (M : M
+ 1) is the content of the word at address M.
LSB
means least significant bit or bits. MSB means most significant bit or bits. Refer-
ences to low and high bytes are spelled out.
LSW
means least significant word or words. MSW means most significant word or
words.
ADDR
is the address bus. ADDR[7:0] are the eight LSB of the address bus.
DATA
is the data bus. DATA[15:8] are the eight MSB of the data bus.
SWSR — Software Watchdog Service Register
SYNCR — Clock Synthesizer Control Register
SYPCR — System Protection Control Register
TCR — TPU Test Configuration Register
TICR — TPU Interrupt Configuration Register
TPUMCR — TPU Module Configuration Register
TRAMBAR — TPURAM Base Address/Status Register
TRAMMCR — TPURAM Module Configuration Register
TRAMTST — TPURAM Test Register
TR[0:F] — QSM Transmit Data RAM
TSTMSRA — Test Module Master Shift Register A
TSTMSRB — Test Module Master Shift Register B
TSTRC — Test Module Repetition Counter
TSTSC — Test Module Shift Count Register
F
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Freescale Semiconductor, Inc.
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Go to: www.freescale.com
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..
.
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PDF描述
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