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參數(shù)資料
| 型號： | SI5369-EVB |
| 廠商： | Silicon Laboratories Inc |
| 文件頁數(shù)： | 20/84頁 |
| 文件大小： | 0K |
| 描述： | BOARD EVAL FOR SI5369 CLK MULT |
| 標準包裝： | 1 |
| 主要目的： | 計時，精密時鐘 |
| 嵌入式： | 否 |
| 已用 IC / 零件： | Si5369 |
| 已供物品： | 板，線纜，CD，文檔 |
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Si5369
Rev. 1.0
27
Reset value = 0100 0010
Reset value = 0000 0101
Register 2.
Bit
D7D6D5D4D3D2D1D0
Name
BWSEL_REG [3:0]
Type
R/W
R
RRR
Bit
Name
Function
7:4
BWSEL_REG [3:0]
BWSEL_REG.
Selects nominal f3dB bandwidth for PLL. See the DSPLLsim for settings. After
BWSEL_REG is written with a new value, an ICAL is required for the change to
take effect.
3:0
Reserved
Register 3.
Bit
D7D6D5D4D3D2D1D0
Name
CKSEL_REG [1:0]
DHOLD
SQ_ICAL
Type
R/W
R
RRR
Bit
Name
Function
7:6
CKSEL_REG [1:0] CKSEL_REG.
If the device is operating in manual register-based clock selection mode
(AUTOSEL_REG = 00), and CKSEL_PIN = 0, then these bits select which input
clock will be the active input clock. If CKSEL_PIN = 1, the CKSEL[1:0] input pins
continue to control clock selection and CKSEL_REG is of no consequence.
00: CKIN_1 selected.
01: CKIN_2 selected.
10: CKIN_3 selected.
11: CKIN_4 selected.
5DHOLD
DHOLD.
Forces the part into digital hold. This bit overrides all other manual and automatic
clock selection controls.
0: Normal operation.
1: Force digital hold mode. Overrides all other settings and ignores the quality of all
of the input clocks.
4
SQ_ICAL
SQ_ICAL.
This bit determines if the output clocks will remain enabled or be squelched (dis-
abled) during an internal calibration. See Table 8.
0: Output clocks enabled during ICAL.
1: Output clocks disabled during ICAL.
3:0
Reserved
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| EEC50DRYH | CONN EDGECARD 100PS DIP .100 SLD |
| AH292-PL-B | IC HALL FAN CTRLR 400MA 5-SIP |
| H3CWH-3036G | IDC CABLE - HKC30H/AE30G/HPL30H |
| ILSB1206ER3R3J | INDUCTOR 3.3UH 1206 |
| H3BBH-5018M | IDC CABLE - HSR50H/AE50M/HSR50H |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| Si5374B-A-BL | 功能描述:時鐘合成器/抖動清除器 Quad DSPLL Jittr Clk Low loop BW 8In/Out RoHS:否 制造商:Skyworks Solutions, Inc. 輸出端數(shù)量: 輸出電平: 最大輸出頻率: 輸入電平: 最大輸入頻率:6.1 GHz 電源電壓-最大:3.3 V 電源電壓-最小:2.7 V 封裝 / 箱體:TSSOP-28 封裝:Reel |
| Si5374B-A-GL | 功能描述:時鐘合成器/抖動清除器 QUAD DSPLL JITT ATT CLK LO LP BW 8IN/OUT RoHS:否 制造商:Skyworks Solutions, Inc. 輸出端數(shù)量: 輸出電平: 最大輸出頻率: 輸入電平: 最大輸入頻率:6.1 GHz 電源電壓-最大:3.3 V 電源電壓-最小:2.7 V 封裝 / 箱體:TSSOP-28 封裝:Reel |
| Si5374-EVB | 功能描述:時鐘和定時器開發(fā)工具 QUAD DSPLL 8IN/8OUT CLOCK EVAL KIT RoHS:否 制造商:Texas Instruments 產(chǎn)品:Evaluation Modules 類型:Clock Conditioners 工具用于評估:LMK04100B 頻率:122.8 MHz 工作電源電壓:3.3 V |
| Si5375B-A-BL | 功能描述:時鐘合成器/抖動清除器 Loop BW 60Hz-8.4 kHz 4In/Out 2kHz-808MHz RoHS:否 制造商:Skyworks Solutions, Inc. 輸出端數(shù)量: 輸出電平: 最大輸出頻率: 輸入電平: 最大輸入頻率:6.1 GHz 電源電壓-最大:3.3 V 電源電壓-最小:2.7 V 封裝 / 箱體:TSSOP-28 封裝:Reel |
| Si5375B-A-GL | 功能描述:時鐘合成器/抖動清除器 QUAD DSPLL JITT ATT CLK ST LP BW 4IN/OUT RoHS:否 制造商:Skyworks Solutions, Inc. 輸出端數(shù)量: 輸出電平: 最大輸出頻率: 輸入電平: 最大輸入頻率:6.1 GHz 電源電壓-最大:3.3 V 電源電壓-最小:2.7 V 封裝 / 箱體:TSSOP-28 封裝:Reel |
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