參數(shù)資料
型號： SC80C52XXX-12SV
廠商： ATMEL CORP
元件分類： 微控制器/微處理器
英文描述： 8-BIT, MROM, 12 MHz, MICROCONTROLLER, CDIP40
封裝： 0.600 INCH, SIDE BRAZED, DIP-40
文件頁數(shù)： 313/1021頁
文件大?。?/td> 15196K
代理商： SC80C52XXX-12SV
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360
32072H–AVR32–10/2012
AT32UC3A3
19.12.7
Configuration Register for Channel x High
Name:
CFGxH
Access Type:
Read/Write
Offset:
0x044 + [x * 0x58]
Reset Value:
0x00000004
DEST_PER: Destination Hardware Handshaking Interface
Assigns a hardware handshaking interface (0 - DMAH_NUM_HS_INT-1) to the destination of channel x if the
CFGx.HS_SEL_DST field is 0. Otherwise, this field is ignored. The channel can then communicate with the destination
peripheral connected to that interface via the assigned hardware handshaking interface.
For correct DMA operation, only one peripheral (source or destination) should be assigned to the same handshaking
interface.
SRC_PER: Source Hardware Handshaking Interface
Assigns a hardware handshaking interface (0 - DMAH_NUM_HS_INT-1) to the source of channel x if the
CFGx.HS_SEL_SRC field is 0. Otherwise, this field is ignored. The channel can then communicate with the source periph-
eral connected to that interface via the assigned hardware handshaking interface.
For correct DMACA operation, only one peripheral (source or destination) should be assigned to the same handshaking
interface.
PROTCTL: Protection Control
Bits used to drive the System Bus HPROT[3:1] bus. The System Bus Specification recommends that the default value of
HPROT indicates a non-cached, nonbuffered, privileged data access. The reset value is used to indicate such an access.
HPROT[0] is tied high as all transfers are data accesses as there are no opcode fetches. There is a one-to-one mapping of
these register bits to the HPROT[3:1] master interface signals.
FIFO_MODE: R/W 0x0 FIFO Mode Select
Determines how much space or data needs to be available in the FIFO before a burst transaction request is serviced.
0 = Space/data available for single System Bus transfer of the specified transfer width.
1 = Space/data available is greater than or equal to half the FIFO depth for destination transfers and less than half the FIFO
depth for source transfers. The exceptions are at the end of a burst transaction request or at the end of a block transfer.
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-
DEST_PER
SRC_PER[3:1]
76
543
21
0
SRC_PER[0]
-
PROTCTL
FIFO_MODE
FCMODE
相關(guān)PDF資料
PDF描述
MR80C52CXXX-12/883:D 8-BIT, MROM, 12 MHz, MICROCONTROLLER, CQCC44
MC80C52EXXX-12SC 8-BIT, MROM, 12 MHz, MICROCONTROLLER, CDIP40
MD80C52TXXX-16SHXXX:D 8-BIT, MROM, 16 MHz, MICROCONTROLLER, CDIP40
MR80C52CXXX-12SCR 8-BIT, MROM, 12 MHz, MICROCONTROLLER, CQCC44
MQ80C52XXX-25 8-BIT, MROM, 25 MHz, MICROCONTROLLER, CQFP44
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參數(shù)描述
SC80-M30/5 制造商:GardTec Inc 功能描述:SC Series 80 mm Steel Bright Nickel Chrome 4 Place Screw Mount Fan Guard
SC80-P10 制造商:GardTec Inc 功能描述:SC Series 80 mm Steel Bright Nickel Chrome 4 Place Screw Mount Fan Guard
SC80-P15/30 制造商:GardTec Inc 功能描述:SC Series Gardtec Fan guard
SC80-P15/45 制造商:GardTec Inc 功能描述:SC Series 80 mm Plastic Polyurethane Foam 4 Place Screw Mount Fan Guard
SC80-P40 制造商:GardTec Inc 功能描述:Plastic Fan Guard
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