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參數(shù)資料
| 型號： | SAFC163-L |
| 廠商： | SIEMENS AG |
| 元件分類： | 圓形連接器 |
| 英文描述： | Circular Connector; No. of Contacts:37; Series:MS27467; Body Material:Aluminum; Connecting Termination:Crimp; Connector Shell Size:15; Circular Contact Gender:Pin; Circular Shell Style:Straight Plug; Insert Arrangement:15-35 RoHS Compliant: No |
| 中文描述： | 16位CMOS單片機 |
| 文件頁數(shù)： | 52/68頁 |
| 文件大?。?/td> | 625K |
| 代理商： | SAFC163-L |
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11Aug98@14:48h Intermediate Version
Semiconductor Group
50
1998-08
C163-L
1) RW-delay and
t
A
refer to the next following bus cycle.
2) Read data are latched with the same clock edge that triggers the address change and the rising RD edge.
Therefore address changes before the end of RD have no impact on read cycles.
CS low to Valid Data In
t
39
SR
–
89
+
t
C
+
2
t
A
–
–
3TCL - 36
+
t
C
+2
t
A
–
ns
CS hold after RD, WR
t
41
CC 22 +
t
F
TCL - 20
+
t
F
TCL - 6
+
t
A
-6
+
t
A
–
ns
ALE falling edge to RdCS,
WrCS (with RW-delay)
t
42
CC 36 +
t
A
–
–
ns
ALE falling edge to RdCS,
WrCS (no RW-delay)
t
43
CC -6 +
t
A
–
–
ns
RdCS to Valid Data In
(with RW-delay)
t
46
SR –
45 +
t
C
2TCL - 38
+
t
C
3TCL
- 38
+
t
C
–
ns
RdCS to Valid Data In
(no RW-delay)
t
47
SR –
87 +
t
C
–
ns
RdCS, WrCS Low Time
(with RW-delay)
t
48
CC 69 +
t
C
–
2TCL - 14
+
t
C
3TCL - 14
+
t
C
2TCL - 30
+
t
C
0
ns
RdCS, WrCS Low Time
(no RW-delay)
t
49
CC 111 +
t
C
–
–
ns
Data valid to WrCS
t
50
CC 53 +
t
C
–
–
ns
Data hold after RdCS
t
51
t
53
SR 0
–
63 +
t
F
–
ns
Data float after RdCS
(with RW-delay)
SR –
–
2TCL - 20
+
t
F
TCL - 20
+
t
F
–
ns
Data float after RdCS
(no RW-delay)
t
68
SR –
22 +
t
F
–
ns
Address hold after
RdCS, WrCS
t
55
CC -20 +
t
F
–
-20 +
t
F
ns
Data hold after WrCS
t
57
CC 26 +
t
F
–
TCL - 16 +
t
F
–
ns
Parameter
Symbol
Max. CPU Clock
= 12 MHz
Variable CPU Clock
1 / 2TCL = 1 to 12 MHz
Unit
min.
max.
min.
max.
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