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參數(shù)資料
| 型號： | R5F56308DDLA |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, FLASH, 100 MHz, MICROCONTROLLER, PBGA100 |
| 封裝： | 5.50 X 5.50 MM, 0.50 MM PITCH, PLASTIC, TFLGA-100 |
| 文件頁數(shù)： | 139/337頁 |
| 文件大小： | 14635K |
| 代理商： | R5F56308DDLA |
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R01UH0040EJ0100 Rev.1.00
Page 223 of 1657
Sep 8, 2011
RX630 Group
8. Voltage Detection Circuit (LVD)
8.2.8
Voltage Monitoring 2 Circuit Control Register 0 (LVD2CR0)
LVD2RIE Bit (Voltage Monitoring 2 Interrupt/Reset Enable)
Ensure that neither an LVD2 reset nor an LVD2 non-maskable interrupt is generated during programming or erasure of
the flash memory.
LVD2DFDIS Bit (Voltage Monitoring 2 Digital Filter Disable Mode Select)
Set the LOCOCR.LCSTP bit to 0 (the LOCO operates) if the LVD1DFDIS bit is 0 (enabling the digital filter circuit).
Set the LVD2DFDIS bit to 1 (digital filter circuit disabled) when using voltage monitoring 2 circuit in software standby
mode or deep software standby mode.
LVD2FSAMP[1:0] Bits (Sampling Clock Select)
The LVD2FSAMP[1:0] bits can be modified only when the LVD2DFDIS bit is 1 (digital filter circuit disabled). The
LVD2FSAMP[1:0] bits should not be modified when the LVD2DFDIS bit is 0 (digital filter circuit enabled).
Address(es): 0008 C29Bh
b7
b6
b5
b4
b3
b2
b1
b0
LVD2R
N
LVD2RI
LVD2FSAMP
[1:0]
—
LVD2C
MPE
LVD2D
FDIS
LVD2RI
E
Value after reset:
1000
x
010
x: Undefined
Bit
Symbol
Bit Name
Description
R/W
b0
Voltage Monitoring 2 Interrupt/Reset
Enable
0: Disabled
1: Enabled
R/W
b1
Voltage Monitoring 2 Digital Filter
Disable Mode Select
0: Digital filter enabled
1: Digital filter disabled
R/W
b2
Voltage Monitoring 2 Circuit
Comparison Result Output Enable
0: Voltage monitoring 2 circuit comparison result output
disabled.
1: Voltage monitoring 2 circuit comparison result output
enabled.
R/W
b3
—
Reserved
The read value is undefined. The write value should be 0.
R/W
b5, b4
Sampling Clock Select
b5 b4
0 0: 1/1 LOCO frequency
0 1: 1/2 LOCO frequency
1 0: 1/4 LOCO frequency
1 1: 1/8 LOCO frequency
R/W
b6
Voltage Monitoring 2 Circuit Mode
Select
0: Voltage monitoring 2 interrupt during Vdet2 passage
1: Voltage monitoring 2 reset enabled when the voltage
falls to and below Vdet2
R/W
b7
Voltage Monitoring 2 Reset Negate
Select
0: Negation follows a stabilization time (tLVD2) after VCC >
Vdet2 is detected.
1: Negation follows a stabilization time (tLVD2) after
assertion of the LVD2 reset.
R/W
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| R5F56308CDLA | 32-BIT, FLASH, 100 MHz, MICROCONTROLLER, PBGA100 |
| R5F56307CDLA | 32-BIT, FLASH, 100 MHz, MICROCONTROLLER, PBGA100 |
| R5F56307DDLA | 32-BIT, FLASH, 100 MHz, MICROCONTROLLER, PBGA100 |
| R5F5630ACDFB | 32-BIT, FLASH, 100 MHz, MICROCONTROLLER, PQFP144 |
| R5F5630BDDFB | 32-BIT, FLASH, 100 MHz, MICROCONTROLLER, PQFP144 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| R5F56308DDLA#U0 | 制造商:Renesas Electronics Corporation 功能描述:RX630 512KB, 64KB LGA100 100MHZ - Trays |
| R5F5630ACDBG | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:Renesas MCUs |
| R5F5630ACDFB | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:Renesas MCUs |
| R5F5630ACDFC | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:Renesas MCUs |
| R5F5630ACDFP | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:Renesas MCUs |
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