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參數(shù)資料
| 型號(hào)： | R5F56308DDLA |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, FLASH, 100 MHz, MICROCONTROLLER, PBGA100 |
| 封裝： | 5.50 X 5.50 MM, 0.50 MM PITCH, PLASTIC, TFLGA-100 |
| 文件頁(yè)數(shù)： | 137/337頁(yè) |
| 文件大?。?/td> | 14635K |
| 代理商： | R5F56308DDLA |
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R01UH0040EJ0100 Rev.1.00
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Sep 8, 2011
RX630 Group
8. Voltage Detection Circuit (LVD)
8.2.7
Voltage Monitoring 1 Circuit Control Register 0 (LVD1CR0)
LVD1RIE Bit (Voltage Monitoring 1 Interrupt/Reset Enable)
Ensure that neither an LVD1 reset nor an LVD1 non-maskable interrupt is generated during programming or erasure of
the flash memory.
LVD1DFDIS Bit (Voltage Monitoring 1 Digital Filter Disable Mode Select)
Set the LOCOCR.LCSTP bit to 0 (the LOCO operates) if the LVD1DFDIS bit is 0 (enabling the digital filter circuit).
Set the LVD1DFDIS bit to 1 (digital filter circuit disabled) when using voltage monitoring 1 circuit in software standby
mode or deep software standby mode.
LVD1FSAMP[1:0] Bits (Sampling Clock Select)
The LVD1FSAMP[1:0] bits can be modified only when the LVD1DFDIS bit is 1 (digital filter circuit disabled). The
LVD1FSAMP[1:0] bits should not be modified when the LVD1DFDIS bit is 0 (digital filter circuit enabled).
Address(es): 0008 C29Ah
b7
b6
b5
b4
b3
b2
b1
b0
LVD1R
N
LVD1RI
LVD1FSAMP
[1:0]
—
LVD1C
MPE
LVD1D
FDIS
LVD1RI
E
Value after reset:
1000
x
010
x: Undefined
Bit
Symbol
Bit Name
Description
R/W
b0
Voltage Monitoring 1
Interrupt/Reset Enable
0: Disabled
1: Enabled
R/W
b1
Voltage Monitoring 1 Digital
Filter Disable Mode Select
0: Digital filter enabled
1: Digital filter disabled
R/W
b2
Voltage Monitoring 1 Circuit
Comparison Result Output
Enable
0: Voltage monitoring 1 circuit comparison result output disabled.
1: Voltage monitoring 1 circuit comparison result output enabled.
R/W
b3
—
Reserved
The read value is undefined. The write value should be 0.
R/W
b5, b4
Sampling Clock Select
b5 b4
0 0: 1/1 LOCO frequency
0 1: 1/2 LOCO frequency
1 0: 1/4 LOCO frequency
1 1: 1/8 LOCO frequency
R/W
b6
Voltage Monitoring 1 Circuit
Mode Select
0: Voltage monitoring 1 interrupt enabled when Vdet1 is crossed
1: Voltage monitoring 1 reset enabled when the voltage falls to
and below Vdet1
R/W
b7
Voltage Monitoring 1 Reset
Negate Select
0: Negation follows a stabilization time (tLVD1) after VCC > Vdet1
is detected.
1: Negation follows a stabilization time (tLVD1) after assertion of
the LVD1 reset.
R/W
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PDF描述 |
|---|---|
| R5F56308CDLA | 32-BIT, FLASH, 100 MHz, MICROCONTROLLER, PBGA100 |
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參數(shù)描述 |
|---|---|
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| R5F5630ACDFB | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:Renesas MCUs |
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| R5F5630ACDFP | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:Renesas MCUs |
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