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參數(shù)資料
| 型號(hào)： | R5F363A6DFA |
| 元件分類(lèi)： | 微控制器/微處理器 |
| 英文描述： | 16-BIT, FLASH, 20 MHz, MICROCONTROLLER, PQFP100 |
| 封裝： | 14 X 20 MM, 0.65 MM PITCH, PLASTIC, QFP-100 |
| 文件頁(yè)數(shù)： | 112/119頁(yè) |
| 文件大?。?/td> | 907K |
| 代理商： | R5F363A6DFA |
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R01DS0033EJ0200 Rev.2.00
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Feb 07, 2011
M16C/63 Group
5. Electrical Characteristics
VCC1 = VCC2 = 3 V
Timing Requirements
(VCC1 = VCC2 = 3 V, VSS = 0 V, at Topr = -20°C to 85°C/-40°C to 85°C unless otherwise specified)
5.3.3
Timing Requirements (Memory Expansion Mode and Microprocessor
Mode)
Notes:
1.
Calculated according to the BCLK frequency as follows:
2.
Calculated according to the BCLK frequency as follows:
n is 1 for 1 wait setting, 2 for 2 waits setting and 3 for 3 waits setting.
3.
Calculated according to the BCLK frequency as follows:
n is 2 for 2 waits setting, 3 for 3 waits setting.
4.
Calculated according to the BCLK frequency as follows:
n is 3 for 2
φ + 3 φ, 4 for 2 φ + 4 φ, 4 for 3 φ + 4 φ, 5 for 4 φ + 5 φ,.
Table 5.56
Memory Expansion Mode and Microprocessor Mode
Symbol
Parameter
Standard
Unit
Min.
Max.
tac1(RD-DB)
Data input access time (for setting with no wait)
(Note 1)
ns
tac2(RD-DB)
Data input access time (for setting with wait)
(Note 2)
ns
tac3(RD-DB)
Data input access time (when accessing multiplex bus area)
(Note 3)
ns
tac4(RD-DB)
Data input access time (for setting with 2
φ + 3 φ or more)
(Note 4)
ns
tsu(DB-RD)
Data input setup time
50
ns
tsu(RDY-BCLK)
RDY input setup time
85
ns
th(RD-DB)
Data input hold time
0ns
th(BCLK-RDY)
RDY input hold time
0ns
0.5
10
9
×
f
BCLK
()
----------------------60 ns
[]
–
n
0.5
+
() 10
9
×
f
BCLK
()
------------------------------------
60 ns
[]
–
n
0.5
–
() 10
9
×
f
BCLK
()
------------------------------------60 ns
[]
–
n
10
9
×
f
BCLK
()
------------------60 ns
[]
–
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