參數(shù)資料
型號(hào)： R5F363A6DFA
元件分類(lèi)： 微控制器/微處理器
英文描述： 16-BIT, FLASH, 20 MHz, MICROCONTROLLER, PQFP100
封裝： 14 X 20 MM, 0.65 MM PITCH, PLASTIC, QFP-100
文件頁(yè)數(shù)： 100/119頁(yè)
文件大?。?/td> 907K
代理商： R5F363A6DFA
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R01DS0033EJ0200 Rev.2.00
Page 81 of 115
Feb 07, 2011
M16C/63 Group
5. Electrical Characteristics
Figure 5.19
Timing Diagram
Read timing
Write timing
BCLK
CSi
ALE
DBi
ADi
BHE
WR, WRL
WRH
BCLK
CSi
ALE
DBi
ADi
BHE
RD
tcyc
td(BCLK-CS)
25ns(max.)
td(BCLK-AD)
25ns(max.)
td(BCLK-ALE)
15ns(max.)
th(BCLK-ALE)
-4ns(min.)
td(BCLK-RD)
25ns(max.)
Hi-Z
tsu(DB-RD)
Hi-Z
td(BCLK-CS)
25ns(max.)
td(BCLK-AD)
25ns(max.)
td(BCLK-ALE)
15ns(max.)
td(BCLK-WR)
25ns(max.)
(0.5 × t
-10)ns(min.)
cyc
tac4(RD-DB)
(n × t
-45)ns(max.)
cyc
V
= V
= 5V
CC1
CC2
Memory Expansion Mode and Microprocessor Mode
(in wait state setting 2
φ + 3 φ, 2 φ + 4 φ, 3φ + 4 φ, and 4 φ + 5 φ, and
when accessing external area)
n: 3 (when 2
φ + 3 φ)
4 (when 2
φ + 4 φ or 3 φ + 4 φ)
5 (when 4
φ + 5 φ)
th(BCLK-AD)
0ns(min.)
th(BCLK-CS)
0ns(min.)
th(RD-AD)
0ns(min.)
th(BCLK-RD)
0ns(min.)
th(RD-DB)
0ns(min.)
th(BCLK-CS)
0ns(min.)
th(BCLK-AD)
0ns(min.)
th(BCLK-ALE)
-4ns(min.)
th(WR-AD)
th(BCLK-WR)
0ns(min.)
td(DB-WR)
th(BCLK-DB)
0ns(min.)
{(n-0.5) × t
-40}ns(min.)
cyc
th(WR-DB)
(0.5 × t
-10)ns(min.)
cyc
Measuring conditions
V
= V
= 5V
CC1
CC2
Input timing voltage: V = 0.8 V, V
= 2.0 V
IL
IH
Output timing voltage: V
= 0.4 V, V
= 2.4 V
OL
OH
tcyc =
1
f(BCLK)
tcyc
td(BCLK-DB)
40ns(max.)
40ns(min.)
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PDF描述
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