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參數(shù)資料
| 型號： | PSD411A1-C-70J |
| 廠商： | 意法半導(dǎo)體 |
| 英文描述： | High Speed CMOS Logic Dual 2-to-4 Line Decoders/Demultiplexers 16-SOIC -55 to 125 |
| 中文描述： | 低成本現(xiàn)場可編程微控制器外圍設(shè)備 |
| 文件頁數(shù)： | 7/123頁 |
| 文件大?。?/td> | 657K |
| 代理商： | PSD411A1-C-70J |
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P
4
PROG.
BUS
INTRF
ADIO
PORT
PROG.
PORT
PROG.
PORT
PORT
C
PROG.
PORT
PORT
D
CONTROL
RD, WR
AD0 – AD15
PC0 – PC7
PD0 – PD7
CLKIN
CLKIN
PAGE
REG.
ZPLD
INPUT
BUS
GLOBAL
CONFIG.
&
SECURITY
PORT
A
POWER
MANAGER
UNIT
VSTDBY
PA0 – PA7
PROG.
PORT
PORT
B
PB0 – PB7
PROG.
PORT
PORT
E
PE0 – PE7
ADDRESS/DATA/CONTROL BUS
PORT A MACROCELLS
PORT B MACROCELLS
PORT E MACROCELLS
(NOTE 2)
27PT
(NOTE 1)
(NOTE 1)
80PT
11PT
CLKIN
256K–1M BIT
EPROM
16 K BITS
SRAM
I/O
DECODER
EPROM
SELECTS
SRAM
SELECT
PERIPHERAL
SELECTS
MACROCELL FEEDBACK OR PORT INPUT
CSIOP
GENERAL PLD
(GPLD)
24 MACROCELLS
DECODE PLD
(DPLD)
NOTES: 1. ZPLD INPUT BUS
– A1 = 36 + CLOCK = 37 INPUTS
– A2 = 58 + CLOCK = 59 INPUTS
2. PORT E MACROCELLS AVAILABLE ON A2 VERSIONS ONLY.
F
P
B
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PDF描述 |
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