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參數(shù)資料
| 型號(hào)： | PPC440GP-3RC500C |
| 廠商： | APPLIEDMICRO INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | Power PC 440GP Embedded Processor |
| 中文描述： | 32-BIT, 500 MHz, RISC PROCESSOR, CBGA552 |
| 封裝： | 25 X 25 MM, ROHS COMPLIANT, CERAMIC, BGA-552 |
| 文件頁(yè)數(shù)： | 79/83頁(yè) |
| 文件大?。?/td> | 773K |
| 代理商： | PPC440GP-3RC500C |
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440GP – Power PC 440GP Embedded Processor
AMCC
79
Revision 1.07 – October 4, 2007
Data Sheet
Example 3:
In this example, ECC is enabled. This requires that Stage 3 data be sampled at
(3)
. If ECC is disabled, the system
will still work, but there will be more latency before the data is sampled into RDSP. Again, T
T
= 1.5ns and T
TE
=
4.3ns at worst case conditions.
DDR SDRAM Read Cycle Timing—Example 3
DQS at pin
PLB Clock
Read Clock Delayed
T
SIN
Data at pin
D0
D1
D2
D3
DQS Stage 1 C
D0
D1
D2
D3
T
DIN
D0
D2
Data in Stage 1 D
D1
D3
Data out Stage 1
High
Low
T
P
D0
D2
D1
D3
Data out Stage 3
with ECC
High
Low
T
T
= Propagation delay from Stage 2 input to RDSP input w/o ECC
T
TE
= Propagation delay from Stage 2 input to RDSP input with ECC
D0
D2
D1
D3
Data out Stage 2
High
Low
Data out RDSP
with ECC
High
Low
(3)
T
P
D0
D2
D1
D3
Data in at RDSP
with ECC
High
Low
D0
D2
D1
D3
T
TE
D0
D2
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PPC440GP-3RC500CZ | Power PC 440GP Embedded Processor |
| PPC440GR-3pbfffCx | Power PC 440GR Embedded Processor |
| PPC440GRx-NpAfffTs | PowerPC 440GRx Embedded Processor |
| PPC440GRx-SpAfffTs | PowerPC 440GRx Embedded Processor |
| PPC440GX-3RF800CZ | Power PC 440GX Embedded Processor |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| PPC440GP-3RC500CZ | 制造商:AMCC 制造商全稱:Applied Micro Circuits Corporation 功能描述:Power PC 440GP Embedded Processor |
| PPC440GR-3JA333C | 制造商:AppliedMicro 功能描述: |
| PPC440GR-3JA400C | 制造商:AppliedMicro 功能描述: |
| PPC440GR-3JA533C | 制造商:AppliedMicro 功能描述: |
| PPC440GR-3JA667C | 制造商:AppliedMicro 功能描述: |
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