參數資料
型號： PIC18F87J60T
廠商： Microchip Technology Inc.
英文描述： 64/80/100-Pin, High-Performance, 1 Mbit Flash Microcontrollers with Ethernet
中文描述： 64/80/100-Pin，高性能，1兆位閃存微控制器與以太網
文件頁數： 152/474頁
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代理商： PIC18F87J60T
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PIC18F97J60 FAMILY
DS39762A-page 150
Advance Information
2006 Microchip Technology Inc.
TABLE 10-12: SUMMARY OF REGISTERS ASSOCIATED WITH PORTE
RE5/AD13/
P1C
RE5
0
O
I
O
I
O
DIG
ST
DIG
TTL
DIG
LATE<5> data output.
PORTE<5> data input.
External memory interface, address/data bit 13 output.
(2)
External memory interface, data bit 13 input.
(2)
ECCP1 Enhanced PWM output, channel C; takes priority over port
and PSP data. May be configured for tri-state during Enhanced PWM
shutdown events.
LATE<6> data output.
PORTE<6> data input.
External memory interface, address/data bit 14 output.
(2)
External memory interface, data bit 14 input.
(2)
ECCP1 Enhanced PWM output, channel B; takes priority over port and
PSP data. May be configured for tri-state during Enhanced PWM
shutdown events.
LATE<7> data output.
PORTE<7> data input.
External memory interface, address/data bit 15 output.
(2)
External memory interface, data bit 15 input.
(2)
CCP2 compare output and CCP2 PWM output; takes priority over
port data.
CCP2 capture input.
ECCP2 Enhanced PWM output, channel A; takes priority over port and
PSP data. May be configured for tri-state during Enhanced PWM
shutdown events.
1
AD13
(1)
x
x
P1C
(3)
0
RE6/AD14/
P1B
(4)
RE6
0
O
I
O
I
O
DIG
ST
DIG
TTL
DIG
1
AD14
(1)
x
x
P1B
(3)
0
RE7/AD15/
ECCP2/P2A
(4)
RE7
0
O
I
O
I
O
DIG
ST
DIG
TTL
DIG
1
AD15
(1)
x
x
ECCP2
(5)
0
1
I
ST
DIG
P2A
(5)
0
O
TABLE 10-11: PORTE FUNCTIONS (CONTINUED)
TRIS
Setting
Pin Name
Function
I/O
I/O
Type
Description
Legend:
O = Output, I = Input, DIG = Digital Output, ST = Schmitt Buffer Input, TTL = TTL Buffer Input,
x
= Don’t care (TRIS bit does not affect port direction or is overridden for this option).
EMB functions implemented on 100-pin devices only.
External memory interface I/O takes priority over all other digital and PSP I/O.
Default assignments for P1B/P1C and P3B/P3C when ECCPMX Configuration bit is set (80-pin and 100-pin devices).
Unimplemented on 64-pin devices.
Alternate assignment for ECCP2/P2A when CCP2MX Configuration bit is cleared (80-pin and 100-pin devices in
Microcontroller mode).
Unimplemented on 64-pin and 80-pin devices.
Note
1:
2:
3:
4:
5:
6:
Name
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
Reset
Values
on page
PORTE
LATE
TRISE
LATA
Legend:
Note 1:
RE7
(1)
LATE7
(1)
TRISE7
(1)
TRISE6
(1)
RDPU
— = unimplemented, read as ‘
0
’. Shaded cells are not used by PORTE.
Unimplemented on 64-pin devices; read as ‘
0
’.
RE6
(1)
LATE6
(1)
RE5
LATE5
TRISE5
LATA5
RE4
LATE4
TRISE4
LATA4
RE3
LATE3
TRISE3
LATA3
RE2
LATE2
TRISE2
LATA2
RE1
LATE1
TRISE1
LATA1
RE0
LATE0
TRISE0
LATA0
62
62
61
62
REPU
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