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參數(shù)資料
| 型號(hào)： | PIC18F87J60 |
| 廠商： | Microchip Technology Inc. |
| 英文描述： | 64/80/100-Pin, High-Performance, 1 Mbit Flash Microcontrollers with Ethernet |
| 中文描述： | 64/80/100-Pin，高性能，1兆位閃存微控制器與以太網(wǎng) |
| 文件頁(yè)數(shù)： | 362/474頁(yè) |
| 文件大小： | 3834K |
| 代理商： | PIC18F87J60 |
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PIC18F97J60 FAMILY
DS39762A-page 360
Advance Information
2006 Microchip Technology Inc.
TABLE 25-1:
OPCODE FIELD DESCRIPTIONS
Field
Description
a
RAM access bit:
a =
0
: RAM location in Access RAM (BSR register is ignored)
a =
1
: RAM bank is specified by BSR register
Bit address within an 8-bit file register (0 to 7).
Bank Select Register. Used to select the current RAM bank.
ALU status bits:
C
arry,
D
igit
C
arry,
Z
ero,
Ov
erflow,
N
egative.
Destination select bit:
d =
0
: store result in WREG
d =
1
: store result in file register f
Destination: either the WREG register or the specified register file location.
8-bit Register file address (00h to FFh), or 2-bit FSR designator (0h to 3h).
12-bit Register file address (000h to FFFh). This is the source address.
12-bit Register file address (000h to FFFh). This is the destination address.
Global Interrupt Enable bit.
Literal field, constant data or label (may be either an 8-bit, 12-bit or a 20-bit value).
Label name.
The mode of the TBLPTR register for the table read and table write instructions.
Only used with table read and table write instructions:
No Change to register (such as TBLPTR with table reads and writes)
Post-Increment register (such as TBLPTR with table reads and writes)
Post-Decrement register (such as TBLPTR with table reads and writes)
Pre-Increment register (such as TBLPTR with table reads and writes)
The relative address (2’s complement number) for relative branch instructions or the direct address for
Call/Branch and Return instructions.
Program Counter.
Program Counter Low Byte.
Program Counter High Byte.
Program Counter High Byte Latch.
Program Counter Upper Byte Latch.
Power-Down bit.
Product of Multiply High Byte.
Product of Multiply Low Byte.
Fast Call/Return mode select bit:
s =
0
: do not update into/from shadow registers
s =
1
: certain registers loaded into/from shadow registers (Fast mode)
21-bit Table Pointer (points to a program memory location).
8-bit Table Latch.
Time-out bit.
Top-of-Stack.
Unused or Unchanged.
Watchdog Timer.
Working register (accumulator).
Don’t care (‘
0
’ or ‘
1
’). The assembler will generate code with x =
0
. It is the recommended form of use for
compatibility with all Microchip software tools.
7-bit offset value for indirect addressing of register files (source).
7-bit offset value for indirect addressing of register files (destination).
Optional argument.
Indicates an indexed address.
The contents of
text
.
Specifies bit
n
of the register indicated by the pointer
expr
.
Assigned to.
Register bit field.
In the set of.
User-defined term (font is Courier).
bbb
BSR
C, DC, Z, OV, N
d
dest
f
f
s
f
d
GIE
k
label
mm
*
*+
*-
+*
n
PC
PCL
PCH
PCLATH
PCLATU
PD
PRODH
PRODL
s
TBLPTR
TABLAT
TO
TOS
u
WDT
WREG
x
z
s
z
d
{ }
[text]
(text)
[expr]<n>
→
< >
∈
italics
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