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參數(shù)資料
| 型號(hào)： | PIC18F87J60 |
| 廠商： | Microchip Technology Inc. |
| 英文描述： | 64/80/100-Pin, High-Performance, 1 Mbit Flash Microcontrollers with Ethernet |
| 中文描述： | 64/80/100-Pin，高性能，1兆位閃存微控制器與以太網(wǎng) |
| 文件頁(yè)數(shù)： | 334/474頁(yè) |
| 文件大小： | 3834K |
| 代理商： | PIC18F87J60 |
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PIC18F97J60 FAMILY
DS39762A-page 332
Advance Information
2006 Microchip Technology Inc.
21.5
A/D Conversions
Figure 21-3 shows the operation of the A/D converter
after the GO/DONE bit has been set and the
ACQT2:ACQT0 bits are cleared. A conversion is
started after the following instruction to allow entry into
Sleep mode before the conversion begins.
Figure 21-4 shows the operation of the A/D converter
after the GO/DONE bit has been set, the ACQT2:ACQT0
bits are set to ‘
010
’ and a 4 T
AD
acquisition time has been
selected before the conversion starts.
Clearing the GO/DONE bit during a conversion will
abort the current conversion. The A/D Result register
pair will NOT be updated with the partially completed
A/D
conversion
sample.
ADRESH:ADRESL registers will continue to contain
the value of the last completed conversion (or the last
value written to the ADRESH:ADRESL registers).
This
means
the
After the A/D conversion is completed or aborted, a
2 T
AD
wait is required before the next acquisition can be
started. After this wait, acquisition on the selected
channel is automatically started.
21.6
Use of the ECCP2 Trigger
An A/D conversion can be started by the “Special Event
Trigger” of the ECCP2 module. This requires that the
CCP2M3:CCP2M0
bits
programmed as ‘
1011
’ and that the A/D module is
enabled (ADON bit is set). When the trigger occurs, the
GO/DONE bit will be set, starting the A/D acquisition
and conversion and the Timer1 (or Timer3) counter will
be reset to zero. Timer1 (or Timer3) is reset to auto-
matically repeat the A/D acquisition period with minimal
software overhead (moving ADRESH/ADRESL to the
desired location). The appropriate analog input
channel must be selected and the minimum acquisition
period is either timed by the user, or an appropriate
T
ACQ
time is selected before the Special Event Trigger
sets the GO/DONE bit (starts a conversion).
(CCP2CON<3:0>)
be
If the A/D module is not enabled (ADON is cleared), the
Special Event Trigger will be ignored by the A/D
module but will still reset the Timer1 (or Timer3)
counter.
A/D CONVERSION T
AD
CYCLES (ACQT2:ACQT0 =
000
, T
ACQ
=
0
)
FIGURE 21-4:
A/D CONVERSION T
AD
CYCLES (ACQT2:ACQT0 =
010
, T
ACQ
= 4 T
AD
)
Note:
The GO/DONE bit should
NOT
be set in
the same instruction that turns on the A/D.
T
AD
1 T
AD
2 T
AD
3 T
AD
4 T
AD
5 T
AD
6 T
AD
7 T
AD
8
b9
b8
b7
T
AD
11
b0
Set GO/DONE bit
Holding capacitor is disconnected from analog input (typically 100 ns)
T
AD
9 T
AD
10
b2
T
CY
- T
AD
Next Q4: ADRESH/ADRESL is loaded, GO/DONE bit is cleared,
ADIF bit is set, holding capacitor is connected to analog input.
Conversion starts
b6
b5
b4
b3
b1
1
2
b9
3
b8
4
5
b6
6
b5
7
b4
8
11
b0
Set GO/DONE bit
(Holding capacitor continues
acquiring input)
(Holding capacitor is disconnected)
9
10
b1
Next Q4: ADRESH:ADRESL is loaded, GO/DONE bit is cleared,
ADIF bit is set, holding capacitor is reconnected to analog input.
Conversion starts
1
2
3
4
T
ACQT
Cycles
T
AD
Cycles
Automatic
Acquisition
Time
b3
b2
b7
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