參數(shù)資料
型號： PIC18F87J10
廠商： Microchip Technology Inc.
英文描述： 64/80-Pin High-Performance, 1-Mbit Flash Microcontrollers with nanoWatt Technology
中文描述： 64/80-Pin高性能，1兆位閃存微控制器與納瓦技術(shù)
文件頁數(shù)： 388/394頁
文件大?。?/td> 3166K
代理商： PIC18F87J10
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PIC18F87J10 FAMILY
DS39663A-page 386
Advance Information
2005 Microchip Technology Inc.
Clock Synchronization .............................................204
Clock/Instruction Cycle ..............................................62
EUSART Synchronous Receive
(Master/Slave) ..................................................367
EUSART Synchronous Transmission
(Master/Slave) ..................................................367
Example SPI Master Mode (CKE = 0) .....................359
Example SPI Master Mode (CKE = 1) .....................360
Example SPI Slave Mode (CKE = 0) .......................361
Example SPI Slave Mode (CKE = 1) .......................362
External Clock (All Modes Except PLL) ...................351
External Memory Bus for Sleep
(Extended Microcontroller Mode) .................92, 94
External Memory Bus for TBLRD
(Extended Microcontroller Mode) .................92, 94
Fail-Safe Clock Monitor ............................................277
First Start Bit Timing ................................................212
Full-Bridge PWM Output ..........................................175
Half-Bridge Output ...................................................174
I
2
C Bus Data ............................................................363
I
2
C Bus Start/Stop Bits .............................................363
I
2
C Master Mode (7 or 10-Bit
Transmission) ..................................................215
I
2
C Master Mode (7-Bit Reception) ..........................216
I
2
C Slave Mode (10-Bit Reception,
SEN = 0) ..........................................................201
I
2
C Slave Mode (10-Bit Reception,
SEN = 1) ..........................................................206
I
2
C Slave Mode (10-Bit Transmission) .....................202
I
2
C Slave Mode (7-bit Reception, SEN = 0) .............199
I
2
C Slave Mode (7-Bit Reception, SEN = 1) ............205
I
2
C Slave Mode (7-Bit Transmission) .......................200
I
2
C Slave Mode General Call Address
Sequence (7 or 10-Bit Address Mode) .............207
I
2
C Stop Condition Receive or
Transmit Mode .................................................217
Master SSP I
2
C Bus Data ........................................365
Master SSP I
2
C Bus Start/Stop Bits ........................365
Parallel Slave Port (PSP) Read ...............................140
Parallel Slave Port (PSP) Write ...............................139
Program Memory Read ............................................354
Program Memory Write ............................................355
PWM Auto-Shutdown (P1RSEN = 0,
Auto-Restart Disabled) .....................................180
PWM Auto-Shutdown (P1RSEN = 1,
Auto-Restart Enabled) .....................................180
PWM Direction Change ...........................................177
PWM Direction Change at Near
100% Duty Cycle .............................................177
PWM Output ............................................................164
Repeated Start Condition .........................................213
Reset, Watchdog Timer (WDT),
Oscillator Start-up Timer (OST)
and Power-up Timer (PWRT) ..........................356
Send Break Character Sequence ............................240
Slave Synchronization .............................................189
Slow Rise Time (MCLR Tied to V
DD
,
V
DD
Rise > T
PWRT
) ............................................47
SPI Mode (Master Mode) .........................................188
SPI Mode (Slave Mode, CKE = 0) ...........................190
SPI Mode (Slave Mode, CKE = 1) ...........................190
Synchronous Reception
(Master Mode, SREN) ......................................243
Synchronous Transmission ......................................241
Synchronous Transmission
(Through TXEN) ...............................................242
Time-out Sequence on Power-up
(MCLR Not Tied to V
DD
), Case 1 ...................... 46
Time-out Sequence on Power-up
(MCLR Not Tied to V
DD
), Case 2 ...................... 47
Time-out Sequence on Power-up
(MCLR Tied to V
DD
, V
DD
Rise < T
PWRT
) ........... 46
Timer0 and Timer1 External Clock .......................... 357
Transition for Entry to Idle Mode ................................ 40
Transition for Entry to SEC_RUN Mode .................... 37
Transition for Entry to Sleep Mode ............................ 39
Transition for Two-Speed Start-up
(INTRC to HSPLL) ........................................... 275
Transition for Wake from Idle to
Run Mode .......................................................... 40
Transition for Wake from Sleep (HSPLL) .................. 39
Transition from RC_RUN Mode to
PRI_RUN Mode ................................................. 38
Transition from SEC_RUN Mode to
PRI_RUN Mode (HSPLL) .................................. 37
Transition to RC_RUN Mode ..................................... 38
Timing Diagrams and Specifications
A/D Conversion Requirements ................................ 369
AC Characteristics
Internal RC Accuracy ....................................... 352
Capture/Compare/PWM Requirements
(Including ECCP Modules) .............................. 358
CLKO and I/O Requirements ........................... 353, 354
EUSART Synchronous Receive
Requirements .................................................. 367
EUSART Synchronous Transmission
Requirements .................................................. 367
Example SPI Mode Requirements
(Master Mode, CKE = 0) .................................. 359
Example SPI Mode Requirements
(Master Mode, CKE = 1) .................................. 360
Example SPI Mode Requirements
(Slave Mode, CKE = 0) .................................... 361
Example SPI Slave Mode Requirements
(CKE = 1) ......................................................... 362
External Clock Requirements .................................. 351
I
2
C Bus Data Requirements
(Slave Mode) ................................................... 364
I
2
C Bus Start/Stop Bits Requirements
(Slave Mode) ................................................... 363
Master SSP I
2
C Bus Data Requirements ................ 366
Master SSP I
2
C Bus Start/Stop Bits
Requirements .................................................. 365
Parallel Slave Port Requirements ............................ 358
PLL Clock ................................................................ 352
Program Memory Write Requirements .................... 355
Reset, Watchdog Timer,
Oscillator Start-up Timer,
Power-up Timer and Brown-out
Reset Requirements ........................................ 356
Timer0 and Timer1 External
Clock Requirements ........................................ 357
Top-of-Stack Access .......................................................... 59
TRISE Register
PSPMODE Bit .......................................................... 138
TSTFSZ ........................................................................... 319
Two-Speed Start-up ................................................. 267, 275
Two-Word Instructions
Example Cases .......................................................... 63
TXSTAx Register
BRGH Bit ................................................................. 229
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PDF描述
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PIC18F87J11-I/PT 功能描述:8位微控制器 -MCU 128KB FL 3936b RAM 10 MIPS 67 I/O RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT
PIC18F87J11T-I/PT 功能描述:8位微控制器 -MCU 128KB Flash 3936bytes RAM 67 I/O RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT
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