參數(shù)資料
型號： PIC16F627A-I/ML
廠商： Microchip Technology
文件頁數(shù)： 163/180頁
文件大?。?/td> 0K
描述： IC MCU FLASH 1KX14 EEPROM 28QFN
產(chǎn)品培訓(xùn)模塊： Asynchronous Stimulus
8-bit PIC® Microcontroller Portfolio
標(biāo)準(zhǔn)包裝： 61
系列： PIC® 16F
核心處理器： PIC
芯體尺寸： 8-位
速度： 20MHz
連通性： UART/USART
外圍設(shè)備： 欠壓檢測/復(fù)位，POR，PWM，WDT
輸入/輸出數(shù)： 16
程序存儲器容量： 1.75KB（1K x 14）
程序存儲器類型： 閃存
EEPROM 大?。?/td> 128 x 8
RAM 容量： 224 x 8
電壓 - 電源 (Vcc/Vdd)： 3 V ~ 5.5 V
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 28-VQFN 裸露焊盤
包裝： 管件
產(chǎn)品目錄頁面： 638 (CN2011-ZH PDF)
配用： AC164324-ND - MODULE SKT FOR MPLAB 8DFN/16QFN
XLT28QFN3-ND - SOCKET TRAN ICE 18DIP/28QFN
I3DBF648-ND - BOARD DAUGHTER ICEPIC3
AC164033-ND - ADAPTER 28QFN TO 18DIP
AC162053-ND - HEADER INTERFACE ICD,ICD2 18DIP
其它名稱： PIC16F627A-I/MLR
PIC16F627A-I/MLR-ND
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁當(dāng)前第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁
2009 Microchip Technology Inc.
DS40044G-page 83
PIC16F627A/628A/648A
FIGURE 12-5:
ASYNCHRONOUS RECEPTION WITH ADDRESS DETECT
FIGURE 12-6:
ASYNCHRONOUS RECEPTION WITH ADDRESS BYTE FIRST
FIGURE 12-7:
ASYNCHRONOUS RECEPTION WITH ADDRESS BYTE FIRST FOLLOWED BY
VALID DATA BYTE
Start
bit
bit 1
bit 0
bit 8
bit 0
Stop
bit
Start
bit
bit 8
Stop
bit
RB1/RX/DT (Pin)
RCV Buffer Reg
RCV Shift Reg
Read RCV
Buffer Reg
RCREG
RCIF
(interrupt flag)
Word 1
RCREG
bit 8 = 0, Data Byte
bit 8 = 1, Address Byte
ADEN = 1
(Address Match
Enable)
‘1’
Note:
This timing diagram shows a data byte followed by an address byte. The data byte is not read into the RCREG
(Receive Buffer) because ADEN = 1 and bit 8 = 0.
Start
bit
bit 1
bit 0
bit 8
bit 0
Stop
bit
Start
bit
bit 8
Stop
bit
RB1/RX/DT (pin)
RCV Buffer Reg
RCV Shift Reg
Read RCV
Buffer Reg
RCREG
RCIF
(Interrupt Flag)
Word 1
RCREG
bit 8 = 1, Address Byte
bit 8 = 0, Data Byte
ADEN = 1
(Address Match
Enable)
‘1’
Note:
This timing diagram shows an address byte followed by an data byte. The data byte is not read into the RCREG
(receive buffer) because ADEN was not updated (still = 1) and bit 8 = 0.
Start
bit
bit 1
bit 0
bit 8
bit 0
Stop
bit
Start
bit
bit 8
Stop
bit
RB1/RX/DT (pin)
Reg
RCV Buffer Reg
RCV Shift
Read RCV
Buffer Reg
RCREG
RCIF
(Interrupt Flag)
Word 2
RCREG
bit 8 = 1, Address Byte
bit 8 = 0, Data Byte
ADEN
(Address Match
Enable)
Word 1
RCREG
Note:
This timing diagram shows an address byte followed by an data byte. The data byte is read into the RCREG
(Receive Buffer) because ADEN was updated after an address match, and was cleared to a ‘0’, so the contents
of the Receive Shift Register (RSR) are read into the Receive Buffer regardless of the value of bit 8.
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