參數(shù)資料
型號(hào)： PIC12HV752-E/P
廠商： Microchip Technology
文件頁(yè)數(shù)： 50/201頁(yè)
文件大?。?/td> 0K
描述： IC MCU 8BIT 1024B FLASH 8-PDIP
標(biāo)準(zhǔn)包裝： 60
系列： PIC® 12F
核心處理器： PIC
芯體尺寸： 8-位
速度： 20MHz
外圍設(shè)備： 欠壓檢測(cè)/復(fù)位，POR，PWM，WDT
輸入/輸出數(shù)： 5
程序存儲(chǔ)器容量： 1.75KB（1K x 14）
程序存儲(chǔ)器類(lèi)型： 閃存
RAM 容量： 64 x 8
電壓 - 電源 (Vcc/Vdd)： 2 V ~ 5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 4x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 125°C
封裝/外殼： 8-DIP（0.300"，7.62mm）
包裝： 管件
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143
7682C–AUTO–04/08
AT90CAN32/64/128
Bit 2 – OCIEnB: Output Compare B Match Interrupt Enable
When this bit is written to one, and the I-flag in the Status Register is set (interrupts globally
enabled), the Timer/Countern Output Compare B Match interrupt is enabled. The corresponding
Interrupt Vector (See “Interrupts” on page 60.) is executed when the OCFnB flag, located in
TIFRn, is set.
Bit 1 – OCIEnA: Output Compare A Match Interrupt Enable
When this bit is written to one, and the I-flag in the Status Register is set (interrupts globally
enabled), the Timer/Countern Output Compare A Match interrupt is enabled. The corresponding
Interrupt Vector (See “Interrupts” on page 60.) is executed when the OCFnA flag, located in
TIFRn, is set.
Bit 0 – TOIEn: Timer/Counter Overflow Interrupt Enable
When this bit is written to one, and the I-flag in the Status Register is set (interrupts globally
enabled), the Timer/Countern Overflow interrupt is enabled. The corresponding Interrupt Vector
(See “Interrupts” on page 60.) is executed when the TOVn flag, located in TIFRn, is set.
13.11.19 Timer/Counter1 Interrupt Flag Register – TIFR1
13.11.20 Timer/Counter3 Interrupt Flag Register – TIFR3
Bit 7..6 – Reserved Bits
These bits are reserved for future use.
Bit 5 – ICFn: Input Capture Flag
This flag is set when a capture event occurs on the ICPn pin. When the Input Capture Register
(ICRn) is set by the WGMn3:0 to be used as the TOP value, the ICFn flag is set when the
counter reaches the TOP value.
ICFn is automatically cleared when the Input Capture Interrupt Vector is executed. Alternatively,
ICFn can be cleared by writing a logic one to its bit location.
Bit 4 – Reserved Bit
This bit is reserved for future use.
Bit 3 – OCFnC: Output Compare C Match Flag
This flag is set in the timer clock cycle after the counter (TCNTn) value matches the Output
Compare Register C (OCRnC).
Note that a Forced Output Compare (FOCnC) strobe will not set the OCFnC flag.
OCFnC is automatically cleared when the Output Compare Match C Interrupt Vector is exe-
cuted. Alternatively, OCFnC can be cleared by writing a logic one to its bit location.
Bit
7
6
5
4
3
2
1
0
–
ICF1
–
OCF1C
OCF1B
OCF1A
TOV1
TIFR1
Read/Write
R
R/W
R
R/W
Initial Value
0
Bit
7
6
5
4
3
2
1
0
–
ICF3
–
OCF3C
OCF3B
OCF3A
TOV3
TIFR3
Read/Write
R
R/W
R
R/W
Initial Value
0
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PDF描述
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