參數(shù)資料
型號： PIC12HV752-E/P
廠商： Microchip Technology
文件頁數(shù)： 106/201頁
文件大?。?/td> 0K
描述： IC MCU 8BIT 1024B FLASH 8-PDIP
標(biāo)準(zhǔn)包裝： 60
系列： PIC® 12F
核心處理器： PIC
芯體尺寸： 8-位
速度： 20MHz
外圍設(shè)備： 欠壓檢測/復(fù)位，POR，PWM，WDT
輸入/輸出數(shù)： 5
程序存儲(chǔ)器容量： 1.75KB（1K x 14）
程序存儲(chǔ)器類型： 閃存
RAM 容量： 64 x 8
電壓 - 電源 (Vcc/Vdd)： 2 V ~ 5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 4x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 125°C
封裝/外殼： 8-DIP（0.300"，7.62mm）
包裝： 管件
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197
7682C–AUTO–04/08
AT90CAN32/64/128
17.11.8
USART1 Control and Status Register C – UCSR1C
Bit 7 – Reserved Bit
This bit is reserved for future use. For compatibility with future devices, these bit must be written
to zero when UCSRnC is written.
Bit 6 – UMSELn: USARTn Mode Select
This bit selects between asynchronous and synchronous mode of operation.
Bit 5:4 – UPMn1:0: Parity Mode
These bits enable and set type of parity generation and check. If enabled, the Transmitter will
automatically generate and send the parity of the transmitted data bits within each frame. The
Receiver will generate a parity value for the incoming data and compare it to the UPMn0 setting.
If a mismatch is detected, the UPEn Flag in UCSRnA will be set.
Bit 3 – USBSn: Stop Bit Select
This bit selects the number of stop bits to be inserted by the Transmitter. The Receiver ignores
this setting.
Bit
7
6
5
4
3
2
1
0
–
UMSEL1
UPM11
UPM10
USBS1
UCSZ11
UCSZ10
UCPO1L
UCSR1C
Read/Write
R
R/W
Initial Value
0
1
0
Table 17-4.
UMSELn Bit Settings
UMSELn
Mode
0
Asynchronous Operation
1
Synchronous Operation
Table 17-5.
UPMn Bits Settings
UPMn1
UPMn0
Parity Mode
0
Disabled
0
1
Reserved
1
0
Enabled, Even Parity
1
Enabled, Odd Parity
Table 17-6.
USBSn Bit Settings
USBSn
Stop Bit(s)
0
1-bit
1
2-bit
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PDF描述
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參數(shù)描述
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