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參數(shù)資料
| 型號： | PEF24901 |
| 英文描述： | ISDN LINE INTERFACE|BASIC|CMOS|QFP|64PIN|PLASTIC |
| 中文描述： | 綜合業(yè)務(wù)數(shù)字網(wǎng)線接口|基本|的CMOS | QFP封裝| 64管腳|塑料 |
| 文件頁數(shù)： | 57/73頁 |
| 文件大小： | 1618K |
| 代理商： | PEF24901 |
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PEB 2466
PEF 2466
Electrical Characteristics and Timing Diagrams
Hardware Reference Manual
48
2001-02-20
8.4.1
Coupling Capacitors at the Analog Interface
Coupling capacitors are required on pins
V
IN
and
V
OUT
.
The recommended value for
V
IN
is >39 nF. The required value for the
V
OUT
capacitor
depends on the input impedance of the SLIC (see
Figure 16
in
Chapter 5.1
).
8.5
Reset Timing
To reset the SICOFI
4-μC to Reset State, logic low pulses applied to pin RESET# must
be below 1.2 V (TTL-Schmitt-Trigger Input) and must persist longer than 3 μs.
Note: Spikes shorter than 1
μ
s will be ignored.
8.4
Analog Interface
V
DD
= 5 V
±
5%; GNDD = 0 V; GNDA = 0 V;
T
A
= 0
°
C to +70
°
C (PEF 2466: -40
°
C to +85
°
C)
Parameter
Symbol
Limit Values
min.
typ.
Unit
Test Condition
max.
Input resistance
PEF 2466
PEB 2466
R
i
160
160
270
270
500
380
0.25
k
k
pF
μA
mV
mV
V
0
≤
V
IN
≤
V
DD
Output resistance
Output load
R
O
R
L
C
L
I
IL
V
IO
V
OO
V
IN
300
50
±
1.0
±
50
±
50
±
2.223
Input leakage current
Input offset voltage
Output offset voltage
Input voltage range (AC)
±
0.1
0
≤
V
IN
≤
V
DD
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