參數(shù)資料
型號(hào)： PCI4515ZHK
廠商： Texas Instruments, Inc.
英文描述： SINGLE SOCKET CARDBUS CONTROLLER WITH INTEGRATED
中文描述： 單插槽CardBus控制器，它集成
文件頁(yè)數(shù)： 28/216頁(yè)
文件大?。?/td> 1138K
代理商： PCI4515ZHK
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210
Table 26. PCI System Terminals
TERMINAL
I/O
DESCRIPTION
NAME
NUMBER
GRST
K05
I
Global reset. When the global reset is asserted, the GRST signal causes the controller to place all output buffers
in a high-impedance state and reset all internal registers. When GRST is asserted, the controller is completely
in its default state. For systems that require wake-up from D3, GRST is normally asserted only during initial boot.
PRST must be asserted following initial boot so that PME context is retained when transitioning from D3 to D0.
For systems that do not require wake-up from D3, GRST must be tied to PRST. When the SUSPEND mode
is enabled, the controller is protected from the GRST, and the internal registers are preserved. All outputs are
placed in a high-impedance state, but the contents of the registers are preserved.
PCLK
L01
I
PCI bus clock. PCLK provides timing for all transactions on the PCI bus. All PCI signals are sampled at the rising
edge of PCLK.
PRST
K03
I
PCI bus reset. When the PCI bus reset is asserted, PRST causes the controller to place all output buffers in
a high-impedance state and reset some internal registers. When PRST is asserted, the controller is completely
nonfunctional. After PRST is deasserted, the controller is in a default state.
When SUSPEND and PRST are asserted, the controller is protected from PRST clearing the internal registers.
All outputs are placed in a high-impedance state, but the contents of the registers are preserved.
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PCI-471LF 制造商:PROTECHSYSTEMS 制造商全稱:PROTECHSYSTEMS 功能描述:PCI ULV Celeron M CPU Card
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