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參數(shù)資料
| 型號： | PCA9564 |
| 廠商： | NXP Semiconductors N.V. |
| 英文描述： | Parallel bus to I2C-bus controller |
| 中文描述： | 并行總線I2C總線控制器 |
| 文件頁數(shù)： | 25/31頁 |
| 文件大?。?/td> | 222K |
| 代理商： | PCA9564 |
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Philips Semiconductors
Product data
PCA9564
Parallel bus to I
2
C-bus controller
2003 Apr 02
25
AC CHARACTERISTICS (2.5 VOLT)
1, 2, 3
CC
amb
áááááááááááááááááááááááááááááááááá
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1. Parameters are valid over specified temperature and voltage range.
2. All voltage measurements are referenced to ground (GND). For testing, all inputs swing between 0 V and 3.0 V with a transition time of 5 ns
maximum. All time measurements are referenced at input voltages of 1.5 V and output voltages shown in Figures 20-21.
3. Test conditions for outputs: C
L
= 50 pF, R
L
= 500
, except open drain outputs. Test conditions for open drain outputs: C
L
= 50 pF, R
L
= 1 k
pullup to V
DD
.
4. Resetting the device while actively communicating on the bus may cause glitches or an errant STOP condition.
5. Upon reset, the full delay will be the sum of t
RES
and the RC time constant of the SDA and SCL bus.
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t
Reset pulse width
t
RES4,5
Time to reset
t
REC
Reset recovery time
Bus Timing (See Figure 20, 21)
AS
AH
CE Hold time from RD, WR LOW
WR, RD pulse width (low time)
t
Data valid after RD and CE LOW
t
DF
Data bus floating after RD or CE HIGH
t
DS
Data bus setup time before WR or CE HIGH (write cycle)
t
DH
Data hold time after WR HIGH
RWD
High time between read and/or write cycles
10
—
ns
250
—
ns
0
—
ns
áááááááááááááááááááááááááááááááááá
áááááááááááááááááááááááááááááááááá
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—
—
0
22
17
—
ns
ns
ns
8
—
ns
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