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參數資料
| 型號： | PA7540SI-15 |
| 英文描述： | PA7540 PEEL Array? Programmable Electrically Erasable Logic Array |
| 中文描述： | PA7540果皮陣列？電可擦除可編程邏輯陣列 |
| 文件頁數： | 5/10頁 |
| 文件大小： | 239K |
| 代理商： | PA7540SI-15 |
5
04-02-051B
waste. Programming of PEEL Arrays is supported by
many popular third party programmers.
Design Security and Signature Word
The PEEL Arrays provide a special EEPROM security bit
that prevents unauthorized reading or copying of designs.
Once set, the programmed bits of the PEEL Arrays
cannot be accessed until the entire chip has been
electrically
erased.
Another
signature word, allows a user-definable code to be
programmed into the PEEL Array. The code can be read
back even after the security bit has been set. The signature
word can be used to identify the pattern programmed in the
device or to record the design revision.
programming
feature,
Figure 11 - WinPLACE Architectural Editor for
PA7540
Figure 12 - WinPLACE LCC and IOC screen
Figure 13 - WinPLACE waveform and
simulator screen
相關PDF資料 |
PDF描述 |
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相關代理商/技術參數 |
參數描述 |
|---|---|
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| PA756-68Z | 功能描述:插座和適配器 PLCC68-DIP40 RoHS:否 制造商:Silicon Labs 產品:Adapter 用于:EM35x |
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| PA7572F-20L | 功能描述:CPLD - 復雜可編程邏輯器件 14 Input 24 I/O 20ns RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100 |
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