參數(shù)資料
型號(hào)： MSP430X43X1
廠商： Texas Instruments, Inc.
英文描述： MIXED SIGNAL MICROCONTROLLER
中文描述： 混合信號(hào)微控制器
文件頁數(shù)： 35/73頁
文件大小： 1156K
代理商： MSP430X43X1
MSP430x43x1, MSP430x43x, MSP430x44x
MIXED SIGNAL MICROCONTROLLER
SLAS344F JANUARY 2002 REVISED MAY 2007
35
POST OFFICE BOX 655303
DALLAS, TEXAS 75265
electrical characteristics over recommended operating free-air temperature (unless otherwise
noted) (continued)
SCHMITT-trigger inputs ports P1, P2, P3, P4, P5, and P6
PARAMETER
TEST CONDITIONS
MIN
TYP
MAX
UNIT
V
IT+
Positive going input threshold voltage
Positive-going input threshold voltage
V
CC
= 2.2 V
V
CC
= 3 V
V
CC
= 2.2 V
V
CC
= 3 V
V
CC
= 2.2 V
V
CC
= 3 V
1.1
1.5
V
1.5
1.9
V
IT
Negative going input threshold voltage
Negative-going input threshold voltage
0.4
0.9
V
0.9
1.3
V
hys
Input voltage hysteresis (V
IT+
V
IT
)
0.3
1.1
V
0.5
1
standard inputs RST/NMI; JTAG: TCK, TMS, TDI/TCLK
PARAMETER
TEST CONDITIONS
MIN
TYP
MAX
UNIT
V
IL
V
IH
Low-level input voltage
V
CC
= 2.2 V / 3 V
= 2 2 V / 3 V
V
SS
V
SS
+0.6
V
High-level input voltage
0.8
×
V
CC
V
CC
V
inputs Px.x, TAx, TBx
PARAMETER
TEST CONDITIONS
V
CC
MIN
TYP
MAX
UNIT
P t P1 P2 P1
Port P1, P2: P1.x to P2.x, external trigger signal
for the interrupt flag, (see Note 1)
t P2
l t i
2.2 V/3 V
1.5
cycle
t
(int)
External interrupt timing
2.2 V
62
ns
3 V
50
Timer A Timer B capture
Timer_A, Timer_B capture
timing
TA0, TA1, TA2
2.2 V
62
t
(cap)
TB0, TB1, TB2, TB3, TB4, TB5, TB6
(see Note 2)
3 V
50
ns
f
(TAext)
Timer_A, Timer_B clock
frequency externally applied
to pin
TACLK TBCLK INCLK: t
TACLK, TBCLK, INCLK:
(H)
= t
(L)
2.2 V
8
MHz
f
(TBext)
3 V
10
f
(TAint)
f
(TBint)
NOTES:
Timer_A, Timer_B clock
frequency
SMCLK or ACLK signal selected
2.2 V
8
MHz
3 V
10
1. The external signal sets the interrupt flag every time the minimum t
(int)
cycle and time parameters are met. It may be set even with
trigger signals shorter than t
(int)
. Both the cycle and timing specifications must be met to ensure the flag is set. t
(int)
is measured in
MCLK cycles.
2. Seven capture/compare registers in ’x44x and three capture/compare registers in ’x43x(1).
leakage current (see Notes 1 and 2)
PARAMETER
TEST CONDITIONS
MIN
TYP
MAX
±
50
±
50
±
50
±
50
±
50
±
50
UNIT
I
lkg(P1.x)
I
lkg(P2.x)
I
lkg(P3.x)
I
lkg(P4.x)
I
lkg(P5.x)
I
lkg(P6.x)
NOTES:
Port P1
Port 1: V
(P1.x)
Port 2: V
(P2.x)
Port 3: V
(P3.x)
Port 4: V
(P4.x)
Port 5: V
(P5.x)
Port 6: V
(P6.x)
Port P2
Leakage
current
Port P3
V
CC
= 2.2 V/3 V
= 2 2 V/3 V
nA
Port P4
Port P5
Port P6
1. The leakage current is measured with V
SS
or V
CC
applied to the corresponding pin(s), unless otherwise noted.
2. The port pin must be selected as input and there must be no optional pullup or pulldown resistor.
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