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參數(shù)資料
| 型號(hào)： | MQ80C52EXXX-36SB |
| 廠商： | TEMIC SEMICONDUCTORS |
| 元件分類(lèi)： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 36 MHz, MICROCONTROLLER, CQFP44 |
| 文件頁(yè)數(shù)： | 119/336頁(yè) |
| 文件大?。?/td> | 8801K |
| 代理商： | MQ80C52EXXX-36SB |
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205
ATmega16M1/32M1/64M1 [DATASHEET]
8209E–AVR–11/2012
Figure 20-13. LIN interrupt mapping.
20.5.14
Message filtering
Message filtering based upon the whole identifier is not implemented. Only a status for frame headers having
0x3C, 0x3D, 0x3E and 0x3F as identifier is available in the LINSIR register.
The LIN protocol says that a message with an identifier from 60 (0x3C) up to 63 (0x3F) uses a classic checksum
(sum over the data bytes only). Software will be responsible for switching correctly the LIN13 bit to provide/check
this expected checksum (the insertion of the ID field in the computation of the CRC is set - or not - just after enter-
ing the Rx or Tx Response command).
20.5.15
Data management
20.5.15.1
LIN FIFO data buffer
To preserve register allocation, the LIN data buffer is seen as a FIFO (with address pointer accessible). This FIFO
is accessed via the LINDX[2..0] field of LINSEL register through the LINDAT register.
LINDX[2..0], the data index, is the address pointer to the required data byte. The data byte can be read or written.
The data index is automatically incremented after each LINDAT access if the LAINC (active low) bit is cleared. A
roll-over is implemented, after data index=7 it is data index=0. Otherwise, if LAINC bit is set, the data index needs
to be written (updated) before each LINDAT access.
The first byte of a LIN frame is stored at the data index=0, the second one at the data index=1, and so on. Never-
theless, LINSEL must be initialized by the user before use.
LIDOK
LINSIR.2
LTXOK
LINSIR.1
LRXOK
LINSIR.0
LABORT
LINERR.7
LTOERR
LINERR.6
LOVERR
LINERR.5
LERR
LINSIR.3
LIN IT
LENERR
LFERR
LINERR.4
LSERR
LINERR.3
LPERR
LINERR.2
LCERR
LINERR.1
LBERR
LINERR.0
LIN ERR
LENIDOK
LINENIR.2
LENTXOK
LINENIR.1
LENRXOK
LINENIR.0
LINENIR.3
Table 20-4.
Frame status
LIDST[2..0]
Frame status
0xx
b
No specific identifier
100
b
60 (0x3C) identifier
101
b
61 (0x3D) identifier
110
b
62 (0x3E) identifier
111
b
63 (0x3F) identifier
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MR80C32E-30SCD | 8-BIT, 30 MHz, MICROCONTROLLER, CQCC44 |
| MD80C52XXX-20SCD | 8-BIT, MROM, 20 MHz, MICROCONTROLLER, CDIP40 |
| MD80C32E-30SC | 8-BIT, 30 MHz, MICROCONTROLLER, CDIP40 |
| MQ83C154DCXXX-16/883 | 8-BIT, MROM, 16 MHz, MICROCONTROLLER, CQFP44 |
| MR80C52CXXX-16SCR | 8-BIT, MROM, 16 MHz, MICROCONTROLLER, CQCC44 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MQ82370-20 | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
| MQ8238020 | 制造商:Intel 功能描述:CONTROLLER: OTHER |
| MQ82380-20 | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
| MQ82380-20/R | 制造商:Rochester Electronics LLC 功能描述: |
| MQ82592 | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
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