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參數(shù)資料
| 型號(hào)： | MPC8377EVRANGA |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, 400 MHz, MICROPROCESSOR, PBGA689 |
| 封裝： | 31 X 31 MM, 2.46 MM HEIGHT, 1 MM PITCH, LEAD FREE, PLASTIC, BGA-689 |
| 文件頁數(shù)： | 36/124頁 |
| 文件大?。?/td> | 1462K |
| 代理商： | MPC8377EVRANGA |
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MPC8377E PowerQUICC II Pro Processor Hardware Specifications, Rev. 2
Freescale Semiconductor
19
DDR1 and DDR2 SDRAM
6.2.2
DDR1 and DDR2 SDRAM Output AC Timing Specifications
Table 20 shows the DDR1 and DDR2 SDRAM output AC timing specifications.
Table 20. DDR1 and DDR2 SDRAM Output AC Timing Specifications
Parameter
Symbol1
Min
Max
Unit
Notes
MCK
n cycle time, MCKn/MCKn crossing
tMCK
510
ns
ADDR/CMD output setup with respect to MCK
400 MHz data rate
333 MHz data rate
266 MHz data rate
200 MHz data rate
tDDKHAS
1.95
2.40
3.15
4.20
—
ns
ADDR/CMD output hold with respect to MCK
400 MHz data rate
333 MHz data rate
266 MHz data rate
200 MHz data rate
tDDKHAX
1.95
2.40
3.15
4.20
—
ns
MCS
n output setup with respect to MCK
400 MHz data rate
333 MHz data rate
266 MHz data rate
200 MHz data rate
tDDKHCS
1.95
2.40
3.15
4.20
—
ns
MCS
n output hold with respect to MCK
400 MHz data rate
333 MHz data rate
266 MHz data rate
200 MHz data rate
tDDKHCX
1.95
2.40
3.15
4.20
—
ns
MCK to MDQS skew
tDDKHMH
–0.6
0.6
ns
MDQ//MDM output setup with respect to MDQS
400 MHz data rate
333 MHz data rate
266 MHz data rate
200 MHz data rate
tDDKHDS,
tDDKLDS
550
800
1100
1200
—
ps
MDQ//MDM output hold with respect to MDQS
400 MHz data rate
333 MHz data rate
266 MHz data rate
200 MHz data rate
tDDKHDX,
tDDKLDX
700
800
1100
1200
—
ps
MDQS preamble start
tDDKHMP
–0.5
× tMCK –0.6
–0.5
× tMCK + 0.6
ns
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